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参数资料
| 型号： | MB89498PMC |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 12.5 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 33/60页 |
| 文件大小： | 1452K |
| 代理商： | MB89498PMC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页
MB89490 Series
DS07-12560-2E
39
(6) I2C Timing
(VCC
= 3.0V, AVSS = VSS = 0.0 V, TA = 40 °C to +85 °C)
*1 : For information in tinst, see “ (4) Instruction Cycle”.
*2 : M is defined in the I2C clock control register ICCR bit 4 and bit 3 (CS4 and CS3). For details, please refer to
the H/W manual register explanation.
*3 : N is defined in the I2C clock control register ICCR bit 2 to bit 0 (CS2 to CS0).
*4 : When the interrupt period is greater than SCL “L” width, SDA and SCL output (Standard) value is based on
hypothesis when rising time is 0 ns.
Parameter
Symbol
Pin
Value
Unit
Remarks
Min
Max
Start condition output
tSTA
SCL
SDA
1/4 tinst*1
×
M
× N 20
1/4 tinst
×
M
× N + 20
ns
At master mode
Stop condition output
tSTO
SCL
SDA
1/4 tinst
×
(M
× N + 8) 20
1/4 tinst
×
(M*2
× N*3 + 8) + 20
ns
At master mode
Start condition detect
tSTA
SCL
SDA
1/4 tinst
× 6 + 40
ns
Stop condition detect
tSTO
SCL
SDA
1/4 tinst
× 6 + 40
ns
Re-start condition
output
tSTASU
SCL
SDA
1/4 tinst
×
(M
× N + 8) 20
1/4 tinst
×
(M
× N + 8) + 20
ns
At master mode
Re-start condition
detect
tSTASU
SCL
SDA
1/4 tinst
× 4 + 40
ns
SCL output LOW width
tLOW
SCL
1/4 tinst
×
M
× N 20
1/4 tinst
×
M
× N + 20
ns
At master mode
SCL output HIGH width
tHIGH
SCL
1/4 tinst
×
(M
× N + 8) 20
1/4 tinst
×
(M
× N + 8) + 20
ns
At master mode
SDA output delay
tDO
SDA
1/4 tinst
× 4 20
1/4 tinst
× 4 + 20
ns
SDA output setup
time after interrupt
tDOSU
SDA
1/4 tinst
× 4 20
ns
*4
SCL input LOW
pulse width
tLOW
SCL
1/4 tinst
× 6 + 40
ns
SCL input HIGH
pulse width
tHIGH
SCL
1/4 tinst
× 2 + 40
ns
SDA input setup time
tSU
SDA
40
ns
SDA hold time
tHO
SDA
0
ns
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PDF描述 |
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