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参数资料
| 型号： | MB89V623P-SH |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, 10 MHz, MICROCONTROLLER, PDIP64 |
| 封装： | PLASTIC, SDIP-64 |
| 文件页数： | 32/61页 |
| 文件大小： | 934K |
| 代理商： | MB89V623P-SH |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页当前第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页
MB89620 Series
38
(8) Bus Write Timing
(VCC = +5.0 V
±10%, FC = 10 MHz, AVSS = VSS= 0.0 V, TA = –40
°C to +85°C)
*1: For information on tinst, see “(4) Instruction Cycle.”
*2: These characteristics are also applicable to the bus read timing.
Parameter
Symbol
Pin
Condition
Value
Unit Remarks
Min.
Max.
Valid address
→ ALE ↓ time tAVLL
AD7 to AD0,
ALE, A15 to A08
—
1/4 tinst*1– 64 ns
—
s
ALE
↓ time → address
invalid time
tLLAX
AD7 to AD0,
ALE, A15 to A08
5—
ns
Valid address
→ WR ↓ time
tAVWL
WR, ALE
1/4 tinst*1– 60 ns
—
s
WR pulse width
tWLWH
WR
1/2 tinst*1– 20 ns
—
s
Write data
→ WR ↑ time
tDVWH
AD7 to AD0, WR
1/2 tinst*1– 60 ns
—
s
WR
↑ → address invalid time tWHAX
WR, A15 to A08
1/4 tinst*1– 40 ns
—ns
WR
↑ → data hold time
tWHDX
AD7 to AD0, WR
1/4 tinst*1– 40 ns
—
s
WR
↑ → ALE ↑ time
tWHLH
WR, ALE
1/4 tinst*1– 40 ns
—
s
WR
↓ → CLK ↑ time
tWLCH
WR, CLK
1/4 tinst*1– 40 ns
—
s
CLK
↓ → WR ↑ time
tCLWH
0—
ns
ALE pulse width
tLHLL
ALE
1/4 tinst*1– 35 ns*2
—
s
ALE
↓ → CLK ↑ time
tLLCH
ALE,CLK
1/4 tinst*1– 30 ns*2
—
s
ALE
AD
A
WR
CLK
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
tCLWH
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
tLLAX
tLHLL
tLLCH
tWHLH
tAVLL
tDVWH
tWHDX
tWLCH
tWHAX
tAVWL
tWLWH
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