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参数资料
| 型号： | MB90367SPMT |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP48 |
| 封装： | PLASTIC, LQFP-48 |
| 文件页数： | 43/59页 |
| 文件大小： | 623K |
| 代理商： | MB90367SPMT |
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MB90360 Series
48
(4) UART0/1
(TA
= 40 °C to +125 °C, VCC = 5.0 V ± 10%, fCP ≤ 24 MHz, VSS = 0 V)
Notes :
AC characteristic in CLK synchronized mode.
CL is load capacity value of pins when testing.
tCP is internal operating clock cycle time (machine clock) . Refer to “ (1) Clock Timing”.
Parameter
Symbol
Pin
Condition
Value
Unit Remarks
Min
Max
Serial clock cycle time
tSCYC
SCK0, SCK1
Internal shift clock
mode output pins
are
CL
= 80 pF + 1 TTL.
8 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SCK0, SCK1,
SOT0, SOT1
80
+80
ns
Valid SIN
→ SCK ↑
tIVSH
SCK0, SCK1,
SIN0, SIN1
100
ns
SCK
↑ → Valid SIN hold time
tSHIX
SCK0, SCK1,
SIN0, SIN1
60
ns
Serial clock “H” pulse width
tSHSL
SCK0, SCK1
External shift clock
mode output pins
are
CL
= 80 pF + 1 TTL.
4 tCP
ns
Serial clock “L” pulse width
tSLSH
SCK0, SCK1
4 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SCK0, SCK1,
SOT0, SOT1
150
ns
Valid SIN
→ SCK ↑
tIVSH
SCK0, SCK1,
SIN0, SIN1
60
ns
SCK
↑ → Valid SIN hold time
tSHIX
SCK0, SCK1,
SIN0, SIN1
60
ns
SCK
SOT
SIN
VIL
VIH
VIL
VIH
2.4 V
0.8 V
2.4 V
0.8 V
tIVSH
tSHIX
tSCYC
tSLOV
Internal Shift Clock Mode
相关PDF资料 |
PDF描述 |
|---|---|
| MB90F362TPMT | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP48 |
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| MB90362TSPMT | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP48 |
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相关代理商/技术参数 |
参数描述 |
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