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参数资料
| 型号： | MB90F337PFM |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 12 X 12 MM, 1.70 MM HEIGHT, 0.65 MM PITCH, PLASTIC, LQFP-64 |
| 文件页数： | 75/92页 |
| 文件大小： | 858K |
| 代理商： | MB90F337PFM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页当前第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页
MB90335 Series
77
(4) UART0, UART1 I/O extended serial timing
(VCC
= 3.3 V ± 0.3 V, VSS = 0.0 V, TA = 40 °C to +85 °C)
Notes :
Above rating is the case of CLK synchronous mode.
CL is a load capacitance value on pins for testing.
tCP is the machine cycle period (unit : ns) . Refer to “ (1) Clock input timing”.
Parameter
Symbol
Pin name
Conditions
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCKx
Internal shift clock
Mode output pin is
CL
= 80 pF + 1 TTL
8 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SCKx
SOTx
80
+ 80
ns
Valid SIN
→ SCK ↑
tIVSH
SCKx
SINx
100
ns
SCK
↑ → valid
SIN hold time
tSHIX
SCKx
SINx
60
ns
Serial clock H pulse width
tSHSL
SCKx, SINx
External shift clock
Mode output pin is
CL
= 80 pF + 1 TTL
4 tCP
ns
Serial clock L pulse width
tSLSH
SCKx, SINx
4 tCP
ns
SCK
↓ → SOT delay time
tSLOV
SCKx
SOTx
150
ns
Valid SIN
→ SCK ↑
tIVSH
SCKx
SINx
60
ns
SCK
↑ → valid
SIN hold time
tSHIX
SCKx
SINx
60
ns
Internal shift clock mode
External shift clock mode
SCK
SOT
SIN
tSCYC
tSLOV
tIVSH
tSHIX
0.8 V
2.4 V
0.8 V
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
SCK
SOT
SIN
tSLSH
tSHSL
tSLOV
tIVSH
tSHIX
0.2 VCC
0.8 VCC
2.4 V
0.8 V
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
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