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参数资料
| 型号： | MB90F883BPF |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 33 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 20 MM, 3.35 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件页数： | 64/80页 |
| 文件大小： | 2171K |
| 代理商： | MB90F883BPF |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页当前第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页
MB90880 Series
DS07-13743-5E
67
(14) Chip select output timing
(VCC
= 2.7 V to 3.6 V, VSS = 0.0 V, TA = 40 °C to +85 °C, fcp ≤ 25 MHz)
*: tCP is the cycle time for the internal operation clock. Refer to (1) “Clock timing ratings”.
Note : The chip select output signal changes simultaneously due to the internal bus configuration; therefore, this
may generate a bus wait. AC cannot be warranted between the ALE output signal and the chip select output
signal.
Parameter
Symbol
Pin name
Conditions
Value
Unit
Min
Max
Chip select output valid time
→ RD↓
tSVRL
CS0 to CS3,
RD
tCP*
/ 2 7
ns
Chip select output valid time
→ WR↓
tSVWL
CS0 to CS3,
WRH, WRL
tCP*
/ 2 7
ns
RD
↑ →
Chip select output valid time
tRHSV
RD,
CS0 to CS3
tCP*
/ 2 17
ns
WR
↑ →
Chip select output valid time
tWHSV
WRH, WRL,
CS0 to CS3
tCP*
/ 2 17
ns
tSVRL
tSVWL
tWHSV
tRHSV
0.8 V
2.4 V
0.8 V
RD
A23 to A16
CS0 to CS3
D15 to D00
WRH, WRL
D15 to D00
Read data
Write data
Un-
defined
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