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参数资料
| 型号： | MB95F168JAPMC-GE1 |
| 厂商： | Fujitsu Semiconductor America Inc |
| 文件页数： | 42/76页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 60K ROM 64LQFP |
| 标准包装： | 1 |
| 系列： | F²MC MB95160MA |
| 核心处理器： | F²MC-8FX |
| 芯体尺寸： | 8-位 |
| 速度： | 16MHz |
| 连通性： | I²C，LIN，SIO，UART/USART |
| 外围设备： | LCD，LVD，POR，PWM，WDT |
| 输入/输出数： | 52 |
| 程序存储器容量： | 60KB（60K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.4 V ~ 5.5 V |
| 数据转换器： | A/D 8x8/10b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 托盘 |
| 产品目录页面： | 722 (CN2011-ZH PDF) |
| 其它名称： | 865-1079 |
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MB95160MA Series
DS07–12624–3E
47
Sampling at the falling edge of sampling clock*1 and prohibited serial clock delay*2
(ESCR register : SCES bit
= 1, ECCR register : SCDE bit = 0)
(VCC
= 5.0 V ± 10%, VSS = 0.0 V, TA = 40 °C to + 85 °C)
*1 : Provide switch function whether sampling of reception data is performed at rising edge or falling edge of
the serial clock.
*2 : Serial clock delay function is used to delay half clock for the output signal of serial clock.
*3 : Refer to “ (2) Source Clock/Machine Clock” for tMCLK.
Parameter
Sym-
bol
Pin name
Conditions
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK
Internal clock
operation output pin :
CL
= 80 pF + 1 TTL.
5 tMCLK*3
ns
SCK
↑→ SOT delay time
tSHOVI
SCK, SOT
95
+ 95
ns
Valid SIN
→SCK↓
tIVSLI
SCK, SIN
tMCLK*3
+ 190
ns
SCK
↓→ valid SIN hold
time
tSLIXI
SCK, SIN
0
ns
Serial clock “H” pulse
width
tSHSL
SCK
External clock
operation output pin :
CL
= 80 pF + 1 TTL.
3 tMCLK*3
tR
ns
Serial clock “L” pulse
width
tSLSH
SCK
tMCLK*3
+ 95
ns
SCK
↑ →SOT delay time tSHOVE SCK, SOT
2 tMCLK*3
+ 95
ns
Valid SIN
→SCK↓
tIVSLE
SCK, SIN
190
ns
SCK
↓→ valid SIN hold
time
tSLIXE
SCK, SIN
tMCLK*3
+ 95
ns
SCK fall time
tF
SCK
10
ns
SCK rise time
tR
SCK
10
ns
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PDF描述 |
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参数描述 |
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