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参数资料
| 型号： | MB95F202KPF-G-SNE2 |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PDSO20 |
| 封装： | 7.50 X 12.70 MM, 2.65 MM HEIGHT, 1.27 MM PITCH, PLASTIC, SOP-20 |
| 文件页数： | 43/72页 |
| 文件大小： | 3340K |
| 代理商： | MB95F202KPF-G-SNE2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页当前第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页
MB95200H/210H Series
48
DS07-12623-3E
Sampling is executed at the rising edge of the sampling clock*1, and serial clock delay is enabled*2.
(ESCR register : SCES bit = 0, ECCR register : SCDE bit = 1)
(VCC = 5.0 V
±10%, VSS = 0.0 V, TA = -40°C to +85°C)
*1: There is a function used to choose whether the sampling of reception data is performed at a rising edge or a
falling edge of the serial clock.
*2: The serial clock delay function is a function that delays the output signal of the serial clock for half clock.
*3: See “(2) Source Clock/Machine Clock” for tMCLK.
Parameter
Symbol Pin name
Condition
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK
Internal clock
operation output pin:
CL = 80 pF
+1 TTL
5 tMCLK*3
—ns
SCK
↑→ SOT delay time
tSHOVI
SCK, SOT
-95
+95
ns
Valid SIN
→ SCK ↓
tIVSLI
SCK, SIN
tMCLK*3
+190
—
ns
SCK
↓→ valid SIN hold time
tSLIXI
SCK, SIN
0
—
ns
SOT
→ SCK ↓ delay time
tSOVLI
SCK, SOT
—
4 tMCLK*3
ns
2.4 V
0.8 V
tSHOVI
tSOVLI
tIVSLI
tSLIXI
2.4 V
0.8 V
2.4 V
0.8 V
SCK
SOT
SIN
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
tSCYC
相关PDF资料 |
PDF描述 |
|---|---|
| MB95F203KP-G-SH-SNE2 | 8-BIT, FLASH, MICROCONTROLLER, PDIP24 |
| MB95F212HPF-G-SNE2 | MICROCONTROLLER, PDSO8 |
| MC9S12P32J0MFTR | MICROCONTROLLER, QCC48 |
| MC8641DVU1500JC | MICROPROCESSOR, CBGA1023 |
| MCM16Z3RVPV16B1 | 16-BIT, MROM, 25.17 MHz, MICROCONTROLLER, PQFP144 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| MB95F203P-G-SH-JNE2 | 制造商:FUJITSU 功能描述: |
| MB95F204HP-G-SH-SNE2 | 制造商:FUJITSU 功能描述:8-bit Microcontroller |
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