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参数资料
型号： MB95F263KPF-G-SNE2
厂商： Fujitsu Semiconductor America Inc
文件页数： 13/87页
文件大小： 0K
描述： IC MCU 8BIT 12KB FLASH 20SOP
标准包装： 1,325
系列： 8FX MB95260H
核心处理器： F²MC-8FX
芯体尺寸： 8-位
速度： 16MHz
连通性： LIN，SIO，UART/USART
外围设备： LVD，POR，PWM，WDT
输入/输出数： 16
程序存储器容量： 12KB（12K x 8）
程序存储器类型： 闪存
RAM 容量： 496 x 8
电压 - 电源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
数据转换器： A/D 6x8/10b
振荡器型： 外部
工作温度： -40°C ~ 85°C
封装/外壳： 20-SOIC（0.295"，7.50mm 宽）
包装： 托盘
其它名称： 865-1210
23
32054F–AVR32–09/09
AT32AP7002
6.3
Programming Model
6.3.1
Register file configuration
The AVR32B architecture specifies that the exception contexts may have a different number of
shadowed registers in different implementations. Figure 6-3 on page 23 shows the model used
in AVR32 AP.
Figure 6-3.
The AVR32 AP Register File
6.3.2
Status register configuration
The Status Register (SR) is splitted into two halfwords, one upper and one lower, see Figure 6-4
on page 23 and Figure 6-5 on page 24. The lower word contains the C, Z, N, V and Q condition
code flags and the R, T and L bits, while the upper halfword contains information about the
mode and state the processor executes in. Refer to the AVR32 Architecture Manual for details.
Figure 6-4.
The Status Register High Halfword
Application
Bit 0
Supervisor
Bit 31
PC
SR
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
SR
R12
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R11
R9
R10
R8
R3
R1
R2
R0
RSR_INT0
SR
RSR_EX
SR
SP_APP
SP_SYS
RSR_NMI
SR
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
FINTPC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
LR_INT3
R12_INT3
R11_INT3
R9_INT3
R10_INT3
R8_INT3
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
RSR_INT1
SR
RSR_INT2
SR
RSR_INT3
SR
INT0
INT1
INT2
INT3
Exception
NMI
FINTPC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
R12
R11
R9
R10
R8
LR
RSR_SUP
RAR_INT0
RAR_EX
RAR_NMI
RAR_INT1
RAR_INT2
RAR_INT3
RAR_SUP
Bit 31
0
Bit 16
Interrupt Level 0 Mask
Interrupt Level 1 Mask
Interrupt Level 3 Mask
Interrupt Level 2 Mask
1
0
1
0
Reserved
FE
I0M
GM
M1
J
D
M0
EM
I2M
DM
-
M2
LC
1
-
Initial value
Bit name
I1M
Mode Bit 0
Mode Bit 1
H
Mode Bit 2
Reserved
Debug State
-
I3M
Java State
Exception Mask
Global Interrupt Mask
Debug State Mask
Java Handle
Reserved
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PDF描述
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