参数资料
| 型号： | MC100EP196FAG |
| 厂商： | ON Semiconductor |
| 文件页数： | 8/18页 |
| 文件大小： | 0K |
| 描述： | IC DELAY LINE 1024TAP 32-LQFP |
| 标准包装： | 250 |
| 系列： | 100EP |
| 标片/步级数： | 1024 |
| 功能： | 可编程 |
| 延迟到第一抽头： | 2.36ns |
| 接头增量： | 10ps |
| 可用的总延迟： | 2.36ns ~ 12.258ns |
| 独立延迟数： | 1 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-LQFP（7x7） |
| 包装： | 托盘 |
| 其它名称： | MC100EP196FAGOS |
MC100EP196
http://onsemi.com
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MultiChannel Deskewing
The most practical application for EP196 is in multiple
channel delay matching. Slight differences in impedance
and cable length can create large timing skews within a
highspeed system. To deskew multiple signal channels,
each channel can be sent through each EP196 as shown in
Figure 8. One signal channel can be used as reference and the
other EP196s can be used to adjust the delay to eliminate the
timing skews. Nearly any highspeed system can be fine
tuned (as small as 10 ps) to reduce the skew to extremely
tight tolerances using the available FTUNE pin.
Figure 8. Multiple Channel Deskewing Diagram
EP196
IN
Q
IN
Q
#1
EP196
IN
Q
IN
Q
#2
EP196
IN
Q
IN
Q
#N
Digital
Data
Control
Logic
DAC
相关PDF资料 |
PDF描述 |
|---|---|
| AD5220BRM100-REEL7 | IC DGTL POT SNGL 128POS 8USOIC |
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| SY55856UHG | IC DELAY LINE 7TAP 32-TQFP |
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| AD5220BR100-REEL7 | IC DGTL POT SNGL 128POS 8-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC100EP196FAG | 制造商:ON Semiconductor 功能描述:Delay Line IC |
| MC100EP196FAR2 | 功能描述:延迟线/计时元素 3.3V/5V ECL RoHS:否 制造商:Micrel 功能:Active Programmable Delay Line 传播延迟时间:1000 ps 工作温度范围: 封装 / 箱体:QFN-24 封装:Tube |
| MC100EP196FAR2G | 功能描述:延迟线/计时元素 3.3V/5V ECL Programmable Delay RoHS:否 制造商:Micrel 功能:Active Programmable Delay Line 传播延迟时间:1000 ps 工作温度范围: 封装 / 箱体:QFN-24 封装:Tube |
| MC100EP210S | 制造商:ONSEMI 制造商全称:ON Semiconductor 功能描述:2.5V1:5 Dual Differential LVDS Compatible Clock Driver |
| MC100EP210S_06 | 制造商:ONSEMI 制造商全称:ON Semiconductor 功能描述:2.5V 1:5 Dual Differential LVDS Compatible Clock Driver |
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