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参数资料
| 型号： | MC145152DW2R2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 18/24页 |
| 文件大小： | 0K |
| 描述： | IC PAR-IN PLL FREQ SYNTH 28-SOIC |
| 标准包装： | 1,000 |
| 类型： | PLL 时钟/频率合成器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 25MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 9 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 28-SOIC W |
| 包装： | 带卷 (TR) |
| 其它名称： | MC145152DW2TR |
MC145151-2 Parallel-Input (Interfaces with Single-Modulus Prescalers)
MC145151-2 and MC145152-2 Technical Data, Rev. 5
Freescale Semiconductor
3
Figure 2. MC145151-2 Block Diagram
1.2
Pin Descriptions
1.2.1
Input Pins
fin
Frequency Input (Pin 1)
Input to the
÷N portion of the synthesizer. f
in is typically derived from loop VCO and is ac coupled into
the device. For larger amplitude signals (standard CMOS logic levels) dc coupling may be used.
RA0 - RA2
Reference Address Inputs (Pins 5, 6, 7)
These three inputs establish a code defining one of eight possible divide values for the total reference
divider, as defined by the table below.
Pull-up resistors ensure that inputs left open remain at a logic 1 and require only a SPST switch to alter
data to the zero state.
Reference Address Code
Total
Divide
Value
RA2
RA1
RA0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
8
128
256
512
1024
2048
2410
8192
14 x 8 ROM REFERENCE DECODER
14-BIT
÷ N COUNTER
φ
V
φ
R
14-BIT
÷ R COUNTER
TRANSMIT OFFSET ADDER
PHASE
DETECTOR
B
PHASE
DETECTOR
A
LOCK
DETECT
LD
PDout
RA2
fin
VDD
OSCin
OSCout
T/R
14
fV
N13
N11
N9
N7 N6
N4
N2
N0
NOTE: N0 - N13 inputs and inputs RA0, RA1, and RA2 have pull-up resistors that are not shown.
RA0
RA1
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PDF描述 |
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参数描述 |
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