参数资料
| 型号： | MC14553BCPG |
| 厂商： | ON Semiconductor |
| 文件页数： | 3/7页 |
| 文件大小： | 0K |
| 描述： | IC COUNTER BCD 3DIGIT CMOS 16DIP |
| 标准包装： | 500 |
| 系列： | 4000B |
| 逻辑类型： | BCD 计数器 |
| 方向： | 上 |
| 元件数： | 1 |
| 每个元件的位元数： | 4 |
| 复位： | 异步 |
| 计时： | 同步 |
| 计数速率： | 7MHz |
| 触发器类型： | 负边沿 |
| 工作温度： | -55°C ~ 125°C |
| 安装类型： | 通孔 |
| 封装/外壳： | 16-DIP（0.300"，7.62mm） |
| 供应商设备封装： | 16-DIP |
| 包装： | 管件 |
| 产品目录页面： | 1130 (CN2011-ZH PDF) |
| 其它名称： | MC14553BCPGOS |
MC14553B
http://onsemi.com
3
Characteristic
Figure
Symbol
VDD
Min
Typ
(Note 6)
Max
Unit
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns
tTLH, tTHL = (0.55 ns/pF) CL + 9.5 ns
2a
tTLH,
tTHL
5.0
10
15
100
50
40
200
100
80
ns
Clock to BCD Out
2a
tPLH,
tPHL
5.0
10
15
900
500
200
1800
1000
400
ns
Clock to Overflow
2a
tPHL
5.0
10
15
600
400
200
1200
800
400
ns
Reset to BCD Out
2b
tPHL
5.0
10
15
900
500
300
1800
1000
600
ns
Clock to Latch Enable Setup Time
Master Reset to Latch Enable Setup Time
2b
tsu
5.0
10
15
600
400
200
300
200
100
ns
Removal Time
Latch Enable to Clock
2b
trem
5.0
10
15
– 80
– 10
0
– 200
– 70
– 50
ns
Clock Pulse Width
2a
tWH(cl)
5.0
10
15
550
200
150
275
100
75
ns
Reset Pulse Width
2b
tWH(R)
5.0
10
15
1200
600
450
600
300
225
ns
Reset Removal Time
trem
5.0
10
15
– 80
0
20
– 180
– 50
– 30
ns
Input Clock Frequency
2a
fcl
5.0
10
15
1.5
5.0
7.0
0.9
2.5
3.5
MHz
Input Clock Rise Time
2b
tTLH
5.0
10
15
No
Limit
ns
Disable, MR, Latch Enable
Rise and Fall Times
tTLH,
tTHL
5.0
10
15
15
5.0
4.0
ms
Scan Oscillator Frequency
(C1 measured in mF)
1
fosc
5.0
10
15
1.5/C1
4.2/C1
7.0/C1
Hz
5. The formulas given are for the typical characteristics only at 25_C.
6. Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.
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PDF描述 |
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