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参数资料
| 型号： | MC15XS3400DPNA |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 19/52页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH HIGH SIDE PWR 24QFN |
| 标准包装： | 168 |
| 类型： | 高端开关 |
| 输出数： | 4 |
| Rds（开）： | 15 毫欧 |
| 内部开关： | 是 |
| 电流限制： | 5A |
| 输入电压： | 6 V ~ 20 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-PowerQFN |
| 供应商设备封装： | 24-PQFN（12x12） |
| 包装： | 托盘 |
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ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 5. Dynamic Electrical Characteristics (continued)
Characteristics noted under conditions 6.0 V ≤ V PWR ≤ 20 V, 3.0 V ≤ V DD ≤ 5.5 V, - 40 ° C ≤ T A ≤ 125 ° C, GND = 0 V, unless
otherwise noted. Typical values noted reflect the approximate parameter means at T A = 25°C under nominal conditions, unless
otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
SPI INTERFACE CHARACTERISTICS (37)
Maximum Frequency of SPI Operation
f SPI
–
–
8.0
MHz
Required Low State Duration for
RST (38)
t WRST
10
–
–
μ s
Rising Edge of CS to Falling Edge of CS (Required Setup Time)
t CS
–
–
1.0
μ s
Rising Edge of RST to Falling Edge of CS (Required Setup Time)
t ENBL
–
–
5.0
μ s
Falling Edge of CS to Rising Edge of SCLK (Required Setup
Time) (39)
t LEAD
–
–
500
ns
Required High State Duration of SCLK (Required Setup Time)
t WSCLKh
–
–
50
ns
Required Low State Duration of SCLK (Required Setup Time)
t WSCLKl
–
–
50
ns
Falling Edge of SCLK to Rising Edge of CS (Required Setup
Time) (39)
t LAG
–
–
60
ns
SI to Falling Edge of SCLK (Required Setup Time)
t SI (SU)
–
–
37
ns
Falling Edge of SCLK to SI (Required Setup
Time) (40)
t SI (HOLD)
–
–
49
ns
SO Rise Time
t RSO
ns
C L = 80 pF
SO Fall Time
C L = 80 pF
t FSO
–
–
–
–
13
13
ns
SI, CS , SCLK, Incoming Signal Rise Time (40)
t RSI
–
–
13
ns
SI, CS , SCLK, Incoming Signal Fall Time
t FSI
–
–
13
ns
Time from Rising Edge of SCLK to SO
Time from Rising Edge of SCLK to SO
Low-impedance (41)
High-impedance (42)
t SO(EN)
t SO(DIS)
–
–
–
–
60
60
ns
ns
Notes
37.
38.
39.
40.
41.
42.
Parameters guaranteed by design.
RST low duration measured with outputs enabled and going to OFF or disabled condition.
Maximum setup time required for the 15XS3400 is the minimum guaranteed time needed from the microcontroller.
Rise and Fall time of incoming SI, CS , and SCLK signals suggested for design consideration to prevent the occurrence of double pulsing.
Time required for output status data to be available for use at SO. 1.0 k Ω on pull-up on CS .
Time required for output status data to be terminated at SO. 1.0 k Ω on pull-up on CS .
15XS3400
Analog Integrated Circuit Device Data
Freescale Semiconductor
19
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参数描述 |
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