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参数资料
| 型号： | MC33580BAPNA |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 8/38页 |
| 文件大小： | 0K |
| 描述： | IC SW QUAD HI SIDE 15MOHM 24PQFN |
| 标准包装： | 168 |
| 类型： | 高端 |
| 输入类型： | SPI |
| 输出数： | 4 |
| 导通状态电阻： | 15 毫欧 |
| 电源电压： | 6 V ~ 27 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-PowerQFN |
| 供应商设备封装： | 24-PQFN（12x12） |
| 包装： | 托盘 |
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ELECTRICAL CHARACTERISTICS
STATIC ELECTICAL CHARACTERISTICS
Table 3. Static Electrical Characteristics (continued)
Characteristics noted under conditions 6.0 V ≤ V PWR ≤ 27 V, 4.5 V ≤ V DD ≤ 5.5 V, - 40 ° C ≤ T A ≤ 125 ° C, GND = 0 V unless
otherwise noted. Typical values noted reflect the approximate parameter means at T A = 25°C under nominal conditions unless
otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
OUTPUTS (HS0, HS1, HS2, HS3) (continued)
Output Fault Detection Threshold
V OFD(THRES)
V
Output Programmed OFF
Output Negative Clamp Voltage
0.5 A < I HS[0:3] < 2.0 A, Output OFF
V CL
2.0
- 20
3.0
–
4.0
-16
V
Overtemperature Shutdown (13)
T SD
155
175
190
° C
Overtemperature Shutdown Hysteresis
T SD(HYS)
5.0
–
20
° C
CONTROL INTERFACE (SCLK, SI, SO, IN[0:3], RST, WAKE, FS, CS, FSI)
Input Logic High Voltage (14)
V IH
0.7 V DD
–
–
V
Input Logic Low Voltage
V IL
–
–
0.2 V DD
V
Input Logic Voltage Hysteresis
V IN(HYS)
100
850
1200
mV
Input Logic Pulldown Current (SCLK, SI, IN[0:3], VIN>0.2 VDD)
RST Input Voltage Range
I DWN
V RST
5.0
4.5
–
5.0
20
5.5
μ A
V
SO, FS Tri-State Capacitance
C SO
–
–
20
pF
Input Logic Pulldown Resistor ( RST ) and WAKE
R DWN
100
200
400
k ?
Input Capacitance
C IN
–
4.0
12
pF
Wake Input Clamp Voltage
V CL(WAKE)
V
I CL(WAKE) < 2.5 mA
Wake Input Forward Voltage
I CL(WAKE) = -2.5 mA
SO High-State Output Voltage
I OH = 1.0 mA
FS , SO Low-State Output Voltage
I OL = -1.6 mA
SO Tri-State Leakage Current
CS>=0.7VDD, 0<VSO<VDD
Input Logic Pullup Current (CS) (17)
Vin < 0.7 VDD
V F(WAKE)
V SOH
V SOL
I SO(LEAK)
I UP
7.0
- 2.0
0.8 V DD
–
- 5.0
5.0
–
–
–
0.2
0
–
14
- 0.3
–
0.4
5.0
20
V
V
V
μ A
μ A
Notes
13. Guaranteed by process monitoring. Not production tested.
14. Upper and lower logic threshold voltage range applies to SI, CS , SCLK, RST , IN[0:3], and WAKE input signals. The WAKE and RST
signals may be supplied by a derived voltage referenced to V PWR .
15.
16.
17.
Ads Input capacitance of SI, CS , SCLK, RST , and WAKE. This parameter is guaranteed by process monitoring but is not production
tested.
The current must be limited by a series resistance when using voltages > 7.0 V.
Pullup current is with CS OPEN. CS has an active internal pullup to V DD .
33580
Analog Integrated Circuit Device Data
8
Freescale Semiconductor
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PDF描述 |
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参数描述 |
|---|---|
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