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参数资料
| 型号： | MC3S12P128J0VFT |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 1.05 MHz, MICROCONTROLLER, QCC48 |
| 封装： | 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, MO-220VKKD-2, QFN-48 |
| 文件页数： | 126/566页 |
| 文件大小： | 7046K |
| 代理商： | MC3S12P128J0VFT |
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S12 Clock, Reset and Power Management Unit (S12CPMU)
S12P-Family Reference Manual, Rev. 1.13
Freescale Semiconductor
211
7.3.2.6
S12CPMU Clock Select Register (CPMUCLKS)
This register controls S12CPMU clock selection.
Read: Anytime
Write:
1. Only possible when PROT=0 (CPMUPROT register).
2. All bits anytime in Special Modes.
3. PLLSEL, PSTP, PRE, PCE, RTIOSCSEL: Anytime in Normal Mode.
4. COPOSCSEL: Anytime in normal mode until CPMUCOP write once has taken place.
If COPOSCSEL was cleared by UPOSC=0 (entering Full Stop Mode with COPOSCSEL=1
or insufcient OSCCLK quality), then COPOSCSEL can be set once again.
After writing CPMUCLKS register, it is strongly recommended to read
back CPMUCLKS register to make sure that write of PLLSEL,
RTIOSCSEL and COPOSCSEL was successful.
0x0039
76543210
R
PLLSEL
PSTP
00
PRE
PCE
RTI
OSCSEL
COP
OSCSEL
W
Reset
10000000
= Unimplemented or Reserved
Figure 7-9. S12CPMU Clock Select Register (CPMUCLKS)
Table 7-5. CPMUCLKS Descriptions
Field
Description
7
PLLSEL
PLL Select Bit
This bit selects the PLLCLK as source of the System Clocks (Core Clock and Bus Clock).
PLLSEL can only be set to 0, if UPOSC=1.
UPOSC= 0 sets the PLLSEL bit.
Entering Full Stop Mode sets the PLLSEL bit.
0 System clocks are derived from OSCCLK if oscillator is up (UPOSC=1, fbus = fosc / 2.
1 System clocks are derived from PLLCLK, fbus = fPLL / 2.
6
PSTP
Pseudo Stop Bit
This bit controls the functionality of the oscillator during Stop Mode.
0 Oscillator is disabled in Stop Mode (Full Stop Mode).
1 Oscillator continues to run in Stop Mode (Pseudo Stop Mode), option to run RTI and COP.
Note: Pseudo Stop Mode allows for faster STOP recovery and reduces the mechanical stress and aging of the
resonator in case of frequent STOP conditions at the expense of a slightly increased power consumption.
Note: When starting up the external oscillator (either by programming OSCE bit to 1 or on exit from Full Stop
Mode with OSCE bit is already 1) the software must wait for a minimum time equivalent to the startup-time
of the external oscillator tUPOSC before entering Pseudo Stop Mode.
相关PDF资料 |
PDF描述 |
|---|---|
| MPC8360EZUAJDGA | 32-BIT, 533 MHz, RISC PROCESSOR, PBGA740 |
| MPC8360VVAHFH | 32-BIT, 500 MHz, RISC PROCESSOR, PBGA740 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC3S12P128J0VFTR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:S12 Microcontrollers |
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| MC3S12P128J0VLHR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:S12 Microcontrollers |
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