- 您现在的位置：买卖IC网 > PDF目录80493 > MC3S12XEP100F1CAG (FREESCALE SEMICONDUCTOR INC) 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP144 PDF资料下载
参数资料
| 型号： | MC3S12XEP100F1CAG |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封装： | LQFP-144 |
| 文件页数： | 829/1324页 |
| 文件大小： | 8453K |
| 代理商： | MC3S12XEP100F1CAG |
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Chapter 14 Enhanced Capture Timer (ECT16B8CV3)
MC9S12XE-Family Reference Manual , Rev. 1.21
552
Freescale Semiconductor
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
Write: Anytime.
All bits reset to zero.
The 8-bit pulse accumulators PAC3 and PAC2 can be enabled only if PAEN in PACTL is cleared. If PAEN
is set, PA3EN and PA2EN have no effect.
The 8-bit pulse accumulators PAC1 and PAC0 can be enabled only if PBEN in PBCTL is cleared. If PBEN
is set, PA1EN and PA0EN have no effect.
14.3.2.22 Delay Counter Control Register (DLYCT)
Read: Anytime
Write: Anytime
All bits reset to zero.
Table 14-25. ICPAR Field Descriptions
Field
Description
3:0
PA[3:0]EN
8-Bit Pulse Accumulator ‘x’ Enable
0 8-Bit Pulse Accumulator is disabled.
1 8-Bit Pulse Accumulator is enabled.
Module Base + 0x0029
76543210
R
DLY7
DLY6
DLY5
DLY4
DLY3
DLY2
DLY1
DLY0
W
Reset
00000000
Figure 14-44. Delay Counter Control Register (DLYCT)
Table 14-26. DLYCT Field Descriptions
Field
Description
7:0
DLY[7:0]
Delay Counter Select — When the PRNT bit of TSCR1 register is set to 0, only bits DLY0, DLY1 are used to
calculate the delay.Table 14-27 shows the delay settings in this case.
When the PRNT bit of TSCR1 register is set to 1, all bits are used to set a more precise delay. Table 14-28 shows
the delay settings in this case. After detection of a valid edge on an input capture pin, the delay counter counts
the pre-selected number of [(dly_cnt + 1)*4]bus clock cycles, then it will generate a pulse on its output if the level
of input signal, after the preset delay, is the opposite of the level before the transition.This will avoid reaction to
narrow input pulses.
Delay between two active edges of the input signal period should be longer than the selected counter delay.
Note: It is recommended to not write to this register while the timer is enabled, that is when TEN is set in register
TSCR1.
Table 14-27. Delay Counter Select when PRNT = 0
DLY1
DLY0
Delay
0
Disabled
相关PDF资料 |
PDF描述 |
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| MB90F345CEPFV | 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP100 |
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参数描述 |
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| MC3S12XEP100F1CALR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1CVLR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MAAR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
| MC3S12XEP100F1MAGR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers |
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