参数资料
| 型号： | MC56F8037VLH |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 168/180页 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT DUAL 64-LQFP |
| 标准包装： | 800 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 32MHz |
| 连通性： | CAN，I²C，SCI，SPI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 53 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 16x12b; D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 托盘 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
| 配用： | MC56F8037EVM-ND - BOARD EVAL FOR MC56F8037 |
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56F8037/56F8027 Data Sheet, Rev. 8
88
Freescale Semiconductor
5.6.11 Fast Interrupt 0 Vector Address High Register (FIVAH0)
Figure 5-13 Fast Interrupt 0 Vector Address High Register (FIVAH0)
5.6.11.1 Reserved—Bits 15–5
This bit field is reserved. Each bit must be set to 0.
5.6.11.2 Fast Interrupt 0 Vector Address High (FIVAH0)—Bits 4–0
The upper five bits of the vector address used for Fast Interrupt 0. This register is combined with FIVAL0
to form the 21-bit vector address for Fast Interrupt 0 defined in the FIM0 register.
5.6.12 Fast Interrupt 1 Match Register (FIM1)
Figure 5-14 Fast Interrupt 1 Match Register (FIM1)
5.6.12.1 Reserved—Bits 15–6
This bit field is reserved. Each bit must be set to 0.
5.6.12.2 Fast Interrupt 1 Vector Number (FAST INTERRUPT 1)—Bits 5–0
These values determine which IRQ will be Fast Interrupt 1. Fast Interrupts vector directly to a service
routine based on values in the Fast Interrupt Vector Address registers without having to go to a jump table
first. IRQs used as Fast Interrupts must be set to priority level 2. Unexpected results will occur if a Fast
Interrupt vector is set to any other priority. A Fast Interrupt automatically becomes the highest priority
level 2 interrupt, regardless of its location in the interrupt table prior to being declared as Fast Interrupt.
Fast Interrupt 0 has priority over Fast Interrupt 1. To determine the vector number of each IRQ, refer to
the vector table.
5.6.13 Fast Interrupt 1 Vector Address Low Register (FIVAL1)
Figure 5-15 Fast Interrupt 1 Vector Address Low Register (FIVAL1)
Base + $A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
FAST INTERRUPT 0 VECTOR
ADDRESS HIGH
Write
RESET
00000
0000000
0000
Base + $B
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
FAST INTERRUPT 1
Write
RESET
00000
0000000
0000
Base + $C
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
FAST INTERRUPT 1 VECTOR ADDRESS LOW
Write
RESET
00000
0000000
0000
相关PDF资料 |
PDF描述 |
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参数描述 |
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