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参数资料
| 型号： | MC68332AVEH25 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 68/88页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 25MHZ 132-PQFP |
| 标准包装： | 36 |
| 系列： | M683xx |
| 核心处理器： | CPU32 |
| 芯体尺寸： | 32-位 |
| 速度： | 25MHz |
| 连通性： | EBI/EMI，SCI，SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 15 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 包装： | 托盘 |
| 产品目录页面： | 733 (CN2011-ZH PDF) |
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MOTOROLA
MC68332
70
MC68332TS/D
NOTES:
1. PQS2 is a digital I/O pin unless the SPI is enabled (SPE in SPCR1 set), in which case it becomes SPI
serial clock SCK.
2. PQS7 is a digital I/O pin unless the SCI transmitter is enabled (TE in SCCR1 = 1), in which case it be-
comes SCI serial output TXD.
DDRQS determines the direction of the TXD pin only when the SCI transmitter is disabled. When the
SCI transmitter is enabled, the TXD pin is an output.
Table 26 Effect of DDRQS on QSM Pin Function
QSM Pin
Mode
DDRQS
Bit
State
Pin Function
MISO
Master
DDQ0
0
Serial Data Input to QSPI
1
Disables Data Input
Slave
0
Disables Data Output
1
Serial Data Output from QSPI
MOSI
Master
DDQ1
0
Disables Data Output
1
Serial Data Output from QSPI
Slave
0
Serial Data Input to QSPI
1
Disables Data Input
SCK1
Master
DDQ2
0
Disables Clock Output
1
Clock Output from QSPI
Slave
0
Clock Input to QSPI
1
Disables Clock Input
PCS0/SS
Master
DDQ3
0
Assertion Causes Mode Fault
1
Chip-Select Output
Slave
0
QSPI Slave Select Input
1
Disables Select Input
PCS[3:1]
Master
DDQ[4:6]
0
Disables Chip-Select Output
1
Chip-Select Output
Slave
0
Inactive
1
Inactive
TXD2
Transmit
DDQ7
X
Serial Data Output from SCI
RXD
Receive
None
NA
Serial Data Input to SCI
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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参数描述 |
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