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参数资料
| 型号： | MC68334GCFC16 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 42/76页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16MHZ 1K RAM 132-PQFP |
| 标准包装： | 36 |
| 系列： | M683xx |
| 核心处理器： | CPU32 |
| 芯体尺寸： | 32-位 |
| 速度： | 16MHz |
| 连通性： | EBI/EMI，UART/USART |
| 输入/输出数： | 47 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 8x8/10b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 包装： | 托盘 |
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MC68334
MC68334TS/D REV. 1
47
DBcc
Dn, label
16
If condition false, then Dn – 1 PC;
if Dn ≠ (– 1), then PC + d PC
DIVS/DIVU
ea, Dn
32/16 16: 16 Destination / Source Destination
(signed or unsigned)
DIVSL/DIVUL
ea, Dr: Dq
ea, Dq
ea, Dr : Dq
64/32 32 : 32
32/32 32
32/32 32 : 32
Destination / Source Destination
(signed or unsigned)
EOR
Dn, ea
8, 16, 32
Source ⊕ Destination Destination
EORI
#data, ea
8, 16, 32
Data ⊕ Destination Destination
EORI to CCR
#data, CCR
8
Source ⊕ CCR CCR
EORI to SR1
#data, SR
16
Source ⊕ SR SR
EXG
Rn, Rn
32
Rn Rn
EXT
Dn
8 16
16 32
Sign extended Destination Destination
EXTB
Dn
8 32
Sign extended Destination Destination
ILLEGAL
none
SSP – 2 SSP; vector offset (SSP);
SSP – 4 SSP; PC (SSP);
SSP – 2 SSP; SR (SSP);
illegal instruction vector address PC
JMP
ea
none
Destination PC
JSR
ea
none
SP – 4 SP; PC (SP); destination PC
LEA
ea, An
32
ea An
LINK
An, #d
16, 32
SP – 4 SP, An (SP); SP An, SP + d SP
LPSTOP1
#data
none
Data SR; interrupt mask EBI; STOP
LSL
Dn, Dn
#data, Dn
ea
8, 16, 32
16
LSR
Dn, Dn
#data, Dn
ea
8, 16, 32
16
MOVE
ea, ea
8, 16, 32
Source Destination
MOVEA
ea, An
16, 32 32
Source Destination
MOVEA1
USP, An
An, USP
32
USP An
An USP
MOVE from
CCR
CCR, ea
16
CCR Destination
MOVE to CCR
ea, CCR
16
Source CCR
MOVE from SR1
SR, ea
16
SR Destination
MOVE to SR1
εα, SR
16
Source SR
MOVE USP1
USP, An
An, USP
32
USP An
An USP
MOVEC1
Rc, Rn
Rn, Rc
32
Rc Rn
Rn Rc
MOVEM
list, ea
ea, list
16, 32
16, 32 32
Listed registers Destination
Source Listed registers
MOVEP
Dn, (d16, An)
(d16, An), Dn
16, 32
Dn [31:24] (An + d); Dn [23:16] (An + d + 2);
Dn [15:8] (An + d + 4); Dn [7:0] (An + d + 6)
(An + d) Dn [31:24]; (An + d + 2) Dn [23:16];
(An + d + 4) Dn [15:8]; (An + d + 6) Dn [7:0]
Table 23 Instruction Set Summary
Instruction
Syntax
Operand Size
Operation
X/C
0
X/C
0
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PDF描述 |
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参数描述 |
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