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参数资料
| 型号： | MC68376BGMFT20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP16 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 311/434页 |
| 文件大小： | 6093K |
| 代理商： | MC68376BGMFT20 |
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MC68336/376
REGISTER SUMMARY
MOTOROLA
USER’S MANUAL
D-61
D.7.7 FCSM Counter Register
The FCSM counter register is a read/write register. A read returns the current value of
the counter. A write loads the counter with the specified value. The counter then
begins incrementing from this new value.
D.7.8 MCSM Status/Interrupt/Control Registers
COF — Counter Overflow Flag
This bit indicates whether or not a counter overflow has occurred. An overflow of the
MCSM counter is defined as the transition of the counter from $FFFF to $xxxx, where
$xxxx is the value contained in the modulus latch. If the IL[2:0] field is non-zero, an
interrupt request is generated when the COF bit is set.
0 = Counter overflow has not occurred
1 = Counter overflow has occurred
This flag bit is set only by hardware and cleared only by software or by system reset.
To clear the flag, first read the bit as a one, then write a zero to the bit.
IL[2:0] — Interrupt Level Field
When the MCSM generates an interrupt request, IL[2:0] determines which of the
interrupt request signals is asserted. When a request is acknowledged, the CTM4
compares IL[2:0] to a mask value supplied by the CPU32 to determine whether to
respond. IL[2:0] must have a value in the range of $0 (interrupts disabled) to $7
(highest priority).
IARB3 — Interrupt Arbitration Bit 3
This bit and the IARB[2:0] field in BIUMCR are concatenated to determine the interrupt
arbitration number for the submodule requesting interrupt service. Refer to D.7.1 BIU
Module Configuration Register for more information on IARB[2:0].
DRV[A:B] — Drive Time Base Bus
This field controls the connection of the MCSM to time base buses A and B. Refer to
FCSMCNT — FCSM Counter Register
$YFF462
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET:
0
MCSM2SIC — MCSM2 Status/Interrupt/Control Register
$YFF410
MCSM11SIC — MCSM11 Status/Interrupt/Control Register
$YFF458
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
COF
IL[2:0]
IARB3
NOT
USED
DRVA
DRVB
IN2
IN1
EDGEN EDGEP
NOT
USED
CLK[2:0]
RESET:
U
0
U
0
336376UMBook Page 61 Friday, November 15, 1996 2:09 PM
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