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参数资料
型号： MC68F375BGMZP33
厂商： Freescale Semiconductor
文件页数： 572/616页
文件大小： 0K
描述： IC MPU 32BIT 33MHZ 217-PBGA
标准包装： 60
系列： M683xx
处理器类型： M683xx 32-位
速度： 33MHz
电压： 5V
安装类型： 表面贴装
封装/外壳： 217-BBGA
供应商设备封装： 217-PBGA（23x23）
包装： 托盘
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MC68F375
INDEX
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
Index-15
synchronization of submodules 13-54
Synchronization to CLKOUT 4-39
Synchronized pulse-width modulation (SPWM) D-39
parameters D-40, D-41
Synchronous
resets 4-55
SYNCR 4-14
SYPCR 4-24
SYS 4-56
System
clock 4-1, 4-5
output (CLKOUT) 4-39
sources 4-6
configuration 4-1, 4-2
protection block (SCIM2) 4-1
reset (SYS) 4-56
–T–
T2CFILTER 8-19
T2CG 8-7, 8-11
T2CLK pin filter control (T2CFILTER) 8-19
T2CSL 8-12
Table stepper motor (TSM) D-7
parameters
master mode D-8
slave mode D-9
TBL 3-15
TC 6-48, 6-53
TCIE 6-46, 6-54
TCNMCR 7-23
TCR 8-12
TCR1P 8-11
TCR2 clock/gate control (T2CG) 8-11
TDRE 6-48
TE 6-44, 6-46
Temporary register A (ATEMP) 3-22
Test submodule reset (TST) 4-56
Three-state control (TSC) 4-69
TICR 8-14, 8-20
TIE 6-46, 6-54
Time
quanta clock 7-9
stamp 7-5, 7-11
time base bus
DASM 13-36
MCSM 13-11
reading 13-52
SASM 13-17, 13-18
selecting 13-11, 13-21, 13-36
Timeout period calculations 4-27
TIMER 7-29
Timer
count register
1 prescaler control (TCR1P) 8-11
synchronize mode (TSYNC) 7-28
toggle 13-18
TOR1 5-43
TOR2 5-43
Totem pole 13-30
totem pole 13-34, 13-36
TOUCAN
address
map 7-20
bit timing configuration 7-8
operation 7-9
external pins 7-2
initialization sequence 7-11
interrupts 7-19
message buffer address map 7-23
operation 7-3
receive process 7-13
registers
control register 0 (CANCTRL0) 7-26
control register 1 (CTRL1) 7-8
control register 1(CANCTRL1) 7-27
control register 2 (CANCTRL2) 7-29
control register 2 (CTRL2) 7-8
error and status register (ESTAT) 7-31
free running timer register (TIMER) 7-29
interrupt
configuration register (CANICR) 7-25
flag register (IFLAG) 7-33
mask register (IMASK) 7-33
module configuration register (TCNMCR) 7-23
receive
buffer 14 mask registers (RX14MSKHI/LO)
7-30
buffer 15 mask registers (RX15MSKHI/LO)
7-31
global mask registers (RXGMSKLO/HI 7-30
RX/TX error counter registers (RXECTR/TXEC-
TR) 7-34
special operating modes 7-16
auto power save mode 7-18
debug mode 7-16
low-power stop mode 7-17
transmit process 7-12
TPU
address map 8-8
components 8-2
FREEZE flag (TPUF) 8-13
function library 8-4
host interface 8-2
interrupts 8-5
microengine 8-2
operation 8-3
coherency 8-4
emulation support 8-4
event timing 8-3
interchannel communication 8-4
programmable channel service priority 8-4
parameter RAM 8-2, 8-21
registers
channel
function select registers (CFSR) 8-15
interrupt
enable register (CIER) 8-5, 8-14
status register (CISR) 8-5, 8-18
priority registers (CPR) 8-17
decoded channel number register (DCNR) 8-18
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
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PDF描述
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参数描述
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