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参数资料
| 型号： | MC68HC05B8B |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | SHRINK, DIP-56 |
| 文件页数： | 282/302页 |
| 文件大小： | 3940K |
| 代理商： | MC68HC05B8B |
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Freescale
6-8
MC68HC05B6
Rev. 4.1
SERIAL COMMUNICATIONS INTERFACE
6
If the receiver detects that a break (RDRF = 1, FE = 1, receiver data register = $0000) produced
the framing error, the start bit will not be artificially induced and the receiver must actually detect
a logic one before the start bit can be recognised (see Figure 6-7).
6.9
Transmit data out (TDO)
Transmit data is the serial data from the internal data bus that is applied through the SCI to the
output line. Data format is as discussed in Section 6.5 and shown in Figure 6-3. The transmitter
generates a bit time by using a derivative of the RT clock, thus producing a transmission rate equal
to 1/16th that of the receiver sample clock (assuming the same baud rate is selected for both the
receiver and transmitter).
Figure 6-6 Artificial start following a framing error
Figure 6-7 SCI start bit following a break
Data
Expected stop
Data samples
Artificial edge
Start bit
Data
RDI
Data
Expected stop
Data samples
Start edge
Start bit
Data
RDI
a) Case 1: receive line low during artificial edge
b) Case 2: receive line high during expected start edge
Expected stop
Data samples
Detected as valid start edge
Start bit
RDI
Break
Start
qualifiers
Start edge
verification
samples
71
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PDF描述 |
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