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参数资料
| 型号： | MC68HC05B8MB |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | PLASTIC, SDIP-56 |
| 文件页数： | 254/305页 |
| 文件大小： | 3702K |
| 代理商： | MC68HC05B8MB |
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MOTOROLA
3-10
MC68HC05B6
Rev. 4
MEMORY AND REGISTERS
3
SFA — Slow or fast mode selection for PLMA (see Section 7.1)
This bit allows the user to select the slow or fast mode of the PLMA pulse length modulation output.
1 (set)
–
Slow mode PLMA (4096 x timer clock period).
0 (clear) –
Fast mode PLMA (256 x timer clock period).
SFB — Slow or fast mode selection for PLMB (see Section 7.1)
This bit allows the user to select the slow or fast mode of the PLMB pulse length modulation output.
1 (set)
–
Slow mode PLMB (4096 x timer clock period).
0 (clear) –
Fast mode PLMB (256 x timer clock period).
Note:
The highest speed of the PLM system corresponds to the frequency of the TOF bit
being set, multiplied by 256. The lowest speed of the PLM system corresponds to the
frequency of the TOF bit being set, multiplied by 16.
Warning: Because the SFA bit and SFB bit are not double buffered, it is mandatory to set the SFA
bit and SFB bit to the desired values before writing to the PLM registers; not doing so
could temporarily give incorrect values at the PLM outputs.
SM — Slow mode (see Section 2.4.3)
1 (set)
–
The system runs at a bus speed 16 times lower than normal
(fOSC/32). SLOW mode affects all sections of the device, including
SCI, A/D and timer.
0 (clear) –
The system runs at normal bus speed (fOSC/2).
The SM bit is cleared by external or power-on reset. The SM bit is automatically cleared when
entering STOP mode.
WDOG — Watchdog enable/disable (see Section 9.1.4)
The WDOG bit can be used to enable the watchdog timer previously disabled by a mask option.
Following a watchdog reset the state of the WDOG bit is as dened by the mask option specied.
Once the watchdog is enabled, the WDOG bit acts as a reset mechanism for the watchdog counter.
Writing a’1’ to this bit clears the counter to its initial value and prevents a watchdog timeout.
1 (set)
–
Watchdog counter cleared and enabled.
0 (clear) –
The watchdog cannot be disabled by software; writing a zero to this
bit has no effect.
TPG
50
05B6Book Page 10 Tuesday, April 6, 1999 8:24 am
相关PDF资料 |
PDF描述 |
|---|---|
| M50958-XXXFP | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP72 |
| M50941-XXXFP | 8-BIT, MROM, 4.3 MHz, MICROCONTROLLER, PQFP72 |
| M37702E4AFS | 16-BIT, UVPROM, 16 MHz, MICROCONTROLLER, CQCC80 |
| MC68HC11E8CB2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PDIP56 |
| MC68010L8X | 16-BIT, 8 MHz, MICROPROCESSOR, CDIP64 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68HC05BD3 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05BD5 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:High-density complementary metal oxide semiconductor (HCMOS) microcontroller unit |
| MC68HC05C0CP | 制造商:Motorola Inc 功能描述: |
| MC68HC05C12 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNITS |
| MC68HC05C12B | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNITS |
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