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参数资料
| 型号： | MC68HC05C12ACB |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP42 |
| 封装： | SHRINK, PLASTIC, DIP-42 |
| 文件页数： | 110/156页 |
| 文件大小： | 756K |
| 代理商： | MC68HC05C12ACB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页当前第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页
Timer
Input Capture Register
MC68HC05C12A — Rev. 3.0
General Release Specification
MOTOROLA
Timer
57
NON-DISCLOSURE
AGREEMENT
REQUIRED
Figure 8-2. Output Compare Operation
8.5 Input Capture Register
Two 8-bit registers, which make up the 16-bit input capture register, are
read-only and are used to latch the value of the free-running counter
after the corresponding input capture edge detector senses a defined
transition. The level transition which triggers the counter transfer is
defined by the corresponding input edge bit (IEDG). Reset does not
affect the contents of the input capture register except when exiting stop
mode.
The result obtained by an input capture will be one more than the value
of the free-running counter on the rising edge of the internal bus clock
preceding the external transition. This delay is required for internal
synchronization. Resolution is one count of the free-running counter,
which is four internal bus clock cycles.
The free-running counter contents are transferred to the input capture
register on each proper signal transition regardless of whether the input
capture flag (ICF) is set or clear. The input capture register always
contains the free-running counter value that corresponds to the most
recent input capture.
After a read of the input capture register ($14) MSB, the counter transfer
is inhibited until the LSB ($15) is also read. This characteristic causes
16-BIT COMPARATOR
OUTPUT COMPARE REGISTER HIGH OUTPUT COMPARE REGISTER LOW
COUNTER HIGH BYTE
TCMP
PIN
CONTROL
LOGIC
TIMER
INTERRUPT
REQUEST
COUNTER LOW BYTE
15
0
158 7
0
TIMER STATUS REGISTER
$0013
TIMER CONTROL REGISTER
$0012
ICIE
OCIE
T
OIE
ICF
OCF
TO
F
相关PDF资料 |
PDF描述 |
|---|---|
| MC68302RC25C | LOCAL AREA NETWORK CONTROLLER, CPGA132 |
| MCM16Z2BMFC20B1 | 16-BIT, MICROCONTROLLER, PQFP132 |
| MCK16Z1CPV20B1 | 16-BIT, MICROCONTROLLER, PQFP144 |
| MC68B52S | 1 CHANNEL(S), SERIAL COMM CONTROLLER, CDIP24 |
| MC68A54P | 1 CHANNEL(S), SERIAL COMM CONTROLLER, PDIP28 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68HC05C12B | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNITS |
| MC68HC05C12CP | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNITS |
| MC68HC05C12P | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNITS |
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