参数资料
型号: MC68HC05JP6PE
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP28
封装: PLASTIC, DIP-28
文件页数: 178/228页
文件大小: 2138K
代理商: MC68HC05JP6PE
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Interrupts
External Interrupts
MC68HC05JJ6/MC68HC05JP6 Rev. 3.0
General Release Specification
MOTOROLA
Interrupts
53
NON-DISCLOSURE
AGREEMENT
REQUIRED
NOTE:
If the port A pins are enabled by mask option as external interrupts, then
a high level on any PA0:PA3 pin will drive the state of the IRQ function
such that the IRQ pin and other PA0:PA3 pins will be ignored until ALL
of the PA0:PA3 pins have returned to a low level. Similarly, if the IRQ pin
is at a low level, the PA0:PA3 pins will be ignored until the IRQ pin
returns to a high state.
4.6.3 IRQ Status and Control Register
The IRQ status and control register (ISCR), shown in Figure 4-4,
contains an external interrupt mask (IRQE), an external interrupt flag
(IRQF), and a flag reset bit (IRQR). Unused bits will read as logic zeros.
The ISCR also contains two control bits for the oscillators, external pin
oscillator, and internal low-power oscillator. Reset sets the IRQE and
OM2 bits; and clears all the other bits.
IRQE — External Interrupt Request Enable
This read/write bit enables external interrupts. Reset sets the IRQE
bit.
1 = External interrupt processing enabled
0 = External interrupt processing disabled
OM1 and OM2 — Oscillator Selects
These bits control the selection and enabling of the oscillator source
for the MCU. One choice is the internal low-power oscillator (LPO).
The other choice is the external pin oscillator (EPO) which is common
to most MC68HC05 MCU devices. The EPO uses external
$000D
Bit 7
654321
Bit 0
Read:
IRQE
OM2
OM1
0
IRQF
0
Write:
R
IRQR
Reset:
110000
U
0
= Unimplemented
R
= Reserved
Figure 4-4. IRQ Status and Control Register (ISCR)
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