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参数资料
| 型号： | MC68HC05K0VDW |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封装： | SOIC-16 |
| 文件页数： | 123/154页 |
| 文件大小： | 1544K |
| 代理商： | MC68HC05K0VDW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页当前第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页
Technical Data
MC68HC05K0 MC68HC05K1 — Rev. 2.0
70
Parallel Input/Output (I/O)
MOTOROLA
Technical Data
When a port A pin is programmed as an output, reading the port bit
actually reads the value of the data latch and not the voltage on the pin
itself. When a port A pin is programmed as an input, reading the port bit
reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its DDR bit. Table 7-1 summarizes the
operations of the port A pins.
7.4 Port B
Port B is a 2-bit, general-purpose, bidirectional I/O port with these
features:
Programmable pulldown devices (mask option)
Oscillator output for 3-pin resistor-capacitor (RC) oscillator mask
option
7.4.1 Port B Data Register
The port B data register (PORTB), shown in Figure 7-5, contains a bit
for each of the port B pins. When a port B pin is programmed to be an
output, the state of its data register bit determines the state of the output
pin. When a port B pin is programmed to be an input, reading the port B
Table 7-1. Port A Pin Functions
Pulldown
Mask
Option
Control Bits
I/O Pin Mode
Accesses
to PDRA
Accesses
to DDRA
Accesses
to PORTA
PDIAx
DDRAx
Read
Write
Read/Write
Read
Write
No
X
0
Input, hi-z
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
No
X
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
Yes
0
Input,
pulldown on
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
Yes
0
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
Yes
1
0
Input, hi-z
U
PDIA7–PDIA0
DDRA7–DDRA0
Pin
PA0–PA7
Yes
1
Output
U
PDIA7–PDIA0
DDRA7–DDRA0
PA0–PA7
X = Don’t care
U = Undefined
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