参数资料
型号: MC68HC08GR32ACFJE
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32
封装: 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, LEAD FREE, MS-026BBA, LQFP-32
文件页数: 151/286页
文件大小: 2074K
代理商: MC68HC08GR32ACFJE
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Timer Interface Module (TIM2)
MC68HC08GR32A MC68HC08GR16A Data Sheet, Rev. 0
234
Freescale Semiconductor
18.7 I/O Signals
Port D shares two of its pins with the TIM2. Port F shares four of its pins with the TIM2. PTD6/T2CH0 is
an external clock input to the TIM2 prescaler. The six TIM2 channel I/O pins are PTD6/T2CH0,
PTD7/T2CH1, PTF4/T2CH2, PTF5/T2CH3, PTF6/T2CH4, and PTF7/T2CH5.
18.7.1 TIM2 Clock Pin (PTD6/T2CH0)
PTD6/T2CH0 is an external clock input that can be the clock source for the TIM2 counter instead of the
prescaled internal bus clock. Select the PTD6/T2CH0 input by writing 1s to the three prescaler select bits,
PS[2:0]. (See 18.8.1 TIM2 Status and Control Register.) The minimum TCLK pulse width is specified in
20.14 Timer Interface Module Characteristics. The maximum TCLK frequency is the least: 4 MHz or bus
frequency
÷ 2.
When the PTD6/PTD6/T2CH0 pin is the TIM2 clock input, it is an input regardless of the state of the
DDRD6 bit in data direction register D.
18.7.2 TIM2 Channel I/O Pins (PTF7/T2CH5:PTF4/T2CH2 and PTD7/T2CH1:PTD6/T2CH0)
Each channel I/O pin is programmable independently as an input capture pin or an output compare pin.
PTD6/T2CH0, PTF4/T2CH2, and PTF6/T2CH4 can be configured as buffered output compare or buffered
PWM pins.
18.8 I/O Registers
These I/O registers control and monitor TIM2 operation:
TIM2 status and control register (T2SC)
TIM2 counter registers (T2CNTH:T2CNTL)
TIM2 counter modulo registers (T2MODH:T2MODL)
TIM2 channel status and control registers (T2SC0, T2SC1, T2SC2, T2SC3, T2SC4, and T2SC5)
TIM2 channel registers (T2CH0H:T2CH0L, T2CH1H:T2CH1L, T2CH2H:T2CH2L,
T2CH3H:T2CH3L, T2CH4H:T2CH4L, and T2CH5H:T2CH5L)
18.8.1 TIM2 Status and Control Register
The TIM2 status and control register:
Enables TIM2 overflow interrupts
Flags TIM2 overflows
Stops the TIM2 counter
Resets the TIM2 counter
Prescales the TIM2 counter clock
Address:
$002B
Bit 7
654321
Bit 0
Read:
TOF
TOIE
TSTOP
00
PS2
PS1
PS0
Write:
0
TRST
Reset:
00100000
= Unimplemented
Figure 18-5. TIM2 Status and Control Register (T2SC)
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