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参数资料
| 型号： | MC68HC08JK8CDW |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO20 |
| 封装： | SOIC-20 |
| 文件页数： | 62/212页 |
| 文件大小： | 1525K |
| 代理商： | MC68HC08JK8CDW |
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Input/Output (I/O) Ports
MC68HC908JL8/JK8 MC68HC08JL8/JK8 MC68HC908KL8 Data Sheet, Rev. 3.1
154
Freescale Semiconductor
DDRA[7:0] — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears DDRA[7:0], configuring all port A pins
as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE
Avoid glitches on port A pins by writing to the port A data register before
changing data direction register A bits from 0 to 1.
Figure 11-4 shows the port A I/O logic.
Figure 11-4. Port A I/O Circuit
When DDRAx is a logic 1, reading address $0000 reads the PTAx data latch. When DDRAx is a logic 0,
reading address $0000 reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its data direction bit.
Table 11-2 summarizes the operation of the port A pins.
Address:
$0004
Bit 7
6
54
32
1
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
000
00
000
Figure 11-3. Data Direction Register A (DDRA)
Table 11-2. Port A Pin Functions
PTAPUE
Bit
DDRA Bit
PTA Bit
I/O Pin Mode
Accesses to DDRA
Accesses to PTA
Read/Write
Read
Write
10
X(1)
1. X = Don’t care.
Input, VDD
(2)
2. Pin pulled to VDD by internal pull-up.
DDRA[7:0]
Pin
PTA[7:0](3)
3. Writing affects data register, but does not affect input.
00
X
Input, Hi-Z(4)
4. Hi-Z = High impedance.
DDRA[7:0]
Pin
PTA[7:0](3)
X
1
X
Output
DDRA[7:0]
PTA[7:0]
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
PTAx
DDRAx
PTAx
INTE
RNAL
D
AT
A
B
U
S
PTAPUEx
To KBI
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PDF描述 |
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参数描述 |
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