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参数资料
| 型号： | MC68HC08JL3EMP |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDIP28 |
| 封装： | PLASTIC, DIP-28 |
| 文件页数： | 15/180页 |
| 文件大小： | 2412K |
| 代理商： | MC68HC08JL3EMP |
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Port D
MC68HC908JL3E Family Data Sheet, Rev. 4
Freescale Semiconductor
111
10.4.2 Data Direction Register D (DDRD)
Data direction register D determines whether each port D pin is an input or an output. Writing a one to a
DDRD bit enables the output buffer for the corresponding port D pin; a zero disables the output buffer.
DDRD[7:0] — Data Direction Register D Bits
These read/write bits control port D data direction. Reset clears DDRD[7:0], configuring all port D pins
as inputs.
1 = Corresponding port D pin configured as output
0 = Corresponding port D pin configured as input
NOTE
Avoid glitches on port D pins by writing to the port D data register before
changing data direction register D bits from 0 to 1. Figure 10-11 shows the
port D I/O logic.
Figure 10-11. Port D I/O Circuit
When DDRDx is a 1, reading address $0003 reads the PTDx data latch. When DDRDx is a 0, reading
address $0003 reads the voltage level on the pin. The data latch can always be written, regardless of the
state of its data direction bit. Table 10-4 summarizes the operation of the port D pins.
Address:
$0007
Bit 7
6
54
32
1
Bit 0
Read:
DDRD7
DDRD6
DDRD5
DDRD4
DDRD3
DDRD2
DDRD1
DDRD0
Write:
Reset:
000
00
000
Figure 10-10. Data Direction Register D (DDRD)
READ DDRD ($0007)
WRITE DDRD ($0007)
RESET
WRITE PTD ($0003)
READ PTD ($0003)
PTDx
DDRDx
PTDx
IN
TERNAL
D
AT
A
B
U
S
PTD[0:3] To Analog-To-Digital Converter
5k
PTDPU[6:7]
PTD[4:5] To Timer
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参数描述 |
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