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参数资料
| 型号： | MC68HC08MR4VFI |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PQFP32 |
| 封装： | LQFP-32 |
| 文件页数： | 65/360页 |
| 文件大小： | 3809K |
| 代理商： | MC68HC08MR4VFI |
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Pulse-Width Modulator for Motor Control (PWMMC)
Fault Protection
MC68HC08MR4/MC68HC908MR8
Advance Information
MOTOROLA
Pulse-Width Modulator for Motor Control (PWMMC)
157
9.7.1 Fault Condition Input Pins
A logic high level on a fault pin disables the respective PWM(s)
determined by the bank and the disable mapping register. Each fault pin
incorporates a filter to assist in rejecting spurious faults. All of the
external fault pins are software-configurable to re-enable the PWMs
either with the fault pin (automatic mode) or with software (manual
mode). Each fault pin has an associated FMODE bit to control the PWM
re-enabling method. Automatic mode is selected by setting the FMODEx
bit in the fault control register. Manual mode is selected when FMODEx
is clear.
NOTE:
PORTC, when used as an input port, mirrors the state of the fault input
pins, as PORTC has the capability of being used as an output port.
When either pin of PORTC is set as an output, by setting its respective
PORTC data direction register bit, the respective fault pin logic is
disconnected from that pin and the fault input will be defaulted to normal
non-fault condition to facilitate the use of PORTC as an output pin and
not interfere with the PWM generator. To regain the fault capability for
the respective fault input pin, clear the PORTC data direction register bit
for that pin.
9.7.1.1 Fault Pin Filter
The two fault pins incorporate a filter to assist in determining a genuine
fault condition. After a fault pin has been logic low for one CPU cycle, a
rising edge (logic high) will be synchronously sampled once per CPU
cycle for two cycles. If both samples are detected logic high, the
corresponding FPIN bit and FFLAG bit will be set. The FPIN bit will
remain set until the corresponding fault pin is logic low and
synchronously sampled once in the following CPU cycle.
9.7.1.2 Automatic Mode
In automatic mode, the PWM(s) are disabled immediately once a filtered
fault condition is detected (logic high). The PWM(s) remain disabled until
the filtered fault condition is cleared (logic low) and a new PWM cycle
begins as shown in Figure 9-24. Clearing the corresponding FFLAGx
event bit will not enable the PWMs in automatic mode.
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC08TV24CFB | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PQFP52 |
| MC68HC705RC17DW | 8-BIT, OTPROM, 2.097 MHz, MICROCONTROLLER, PDSO28 |
| MC68HC705RC17P | 8-BIT, OTPROM, 2.097 MHz, MICROCONTROLLER, PDIP28 |
| MC74AC112DR2 | AC SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16 |
| MC74AC253N | AC SERIES, DUAL 4 LINE TO 1 LINE MULTIPLEXER, TRUE OUTPUT, PDIP16 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68HC08P4 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:HCMOS MICROCONTROLLER UNIT |
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| MC68HC08QT2 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:M68HC08 Microcontrollers |
| MC68HC08QT4 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:M68HC08 Microcontrollers |
| MC68HC08QY1 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:M68HC08 Microcontrollers |
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