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参数资料
| 型号： | MC68HC11ED0CFN2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, 2 MHz, MICROCONTROLLER, PQCC44 |
| 封装： | PLASTIC, LCC-44 |
| 文件页数： | 73/108页 |
| 文件大小： | 1672K |
| 代理商： | MC68HC11ED0CFN2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页当前第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页
Parallel Input/Output (I/O) Ports
Pulse Accumulator Control Register
MC68HC11ED0 — Rev. 1.0
Technical Summary
Parallel Input/Output (I/O) Ports
6.4 Pulse Accumulator Control Register
Refer to Figure 6-2 for a description of the pulse accumulator control
register (PACTL).
DDRA7 — Data Direction for Port A Bit 7
0 = Input
1 = Output
PAEN — Pulse Accumulator System Enable Bit
Refer to 9.4 Pulse Accumulator.
PAMOD — Pulse Accumulator Mode Bit
Refer to 9.4 Pulse Accumulator.
PEDGE — Pulse Accumulator Edge Control Bit
Refer to 9.4 Pulse Accumulator.
DDRA3 — Data Direction for Port A Bit 3
This bit is overridden if an output compare function is configured to
control the PA3 pin.
0 = Input
1 = Output
I4/O5 — Input Capture 4/Output Compare 5 Bit
Refer to Section 9. Timing System.
RTR[1:0] — Real-Time Interrupt (RTI) Rate Select Bits
Refer to 9.4 Pulse Accumulator.
Address:
$0026
Bit 7
6
54321
Bit 0
Read:
DDRA7
PAEN
PAMOD
PEDGE
DDRA3
I4/O5
RTR1
RTR0
Write:
Reset:
00
000000
Figure 6-2. Pulse Accumulator Control Register (PACTL)
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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