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参数资料
| 型号： | MC68HC705C9ACFB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | QFP-44 |
| 文件页数： | 55/118页 |
| 文件大小： | 750K |
| 代理商： | MC68HC705C9ACFB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页当前第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页
MC68HC05C9A Compatible COP
MC68HC05C9A Advance Information Data Sheet, Rev. 4.1
Freescale Semiconductor
41
5.5 MC68HC05C9A Compatible COP
This COP is controlled with two registers; one to reset the COP timer and the other to enable and control
COP and clock monitor functions. Figure 5-3 shows a block diagram of the MC68HC05C9A COP.
Figure 5-3. C9A COP Block Diagram
5.5.1 C9A COP Reset Register
This write-only register, shown in Figure 5-4, is used to reset the COP.
The sequence required to reset the COP timer is:
Write $55 to the COP reset register
Write $AA to the COP reset register
Both write operations must occur in the order listed, but any number of instructions may be executed
between the two write operations provided that the COP does not time out between the two writes. The
elapsed time between software resets must not be greater than the COP timeout period. If the COP
should time out, a system reset will occur and the device will be re-initialized in the same fashion as a
power-on reset or reset.
Reading this register does not return valid data.
5.5.2 C9A COP Control Register
The COP control register, shown in Figure 5-5, performs these functions:
Enables clock monitor function
Enables MC68HC05C9A compatible COP function
Selects timeout duration of COP timer
and flags the following conditions:
A COP timeout
Clock monitor reset
$001D
Bit 7
6543
2
1
Bit 0
Read:
Write:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset:
00000
0
= Unimplemented
Figure 5-4. COP Reset Register (COPRST)
÷2 ÷2 ÷2 ÷2 ÷2 ÷2 ÷2 ÷2
÷4
÷2
213
215
217
219
221
COPRST
CM0
CM1
16 BIT TIMER SYSTEM
INTERNAL
CPU
CLOCK
COP
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PDF描述 |
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