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参数资料
| 型号： | MC68HC705F32FU |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | QFP-80 |
| 文件页数： | 135/198页 |
| 文件大小： | 2335K |
| 代理商： | MC68HC705F32FU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页当前第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页
MC68HC05F32
MOTOROLA
3-7
MEMORY AND REGISTERS
3
ER1, ER0 — Erase select bits
ER1 and ER0 are used to select either single byte programming or one of three erase modes:
byte, block, or bulk. Table 3-2 shows the mode selected for each bit conguration. These bits are
readable and writable and are cleared by reset.
–
In byte erase mode, only the selected byte is erased.
–
In block erase mode, a 32-byte block of EEPROM is erased. The EEPROM
memory space is divided into four 64-byte blocks ($0400 – $043F, $0440 –
$047F, $0480 – $04BF and $04C0 – $04FF) and performing a block erase
on any address within a block will erase the entire block.
–
In bulk erase mode, the entire 256 bytes of EEPROM are erased.
LATCH — EEPROM latch bit
1 (set)
–
EEPROM address and data buses are congured for programming.
0 (clear) –
EEPROM address and data buses are congured for normal
operation.
When set, the LATCH bit congures the EEPROM address and data buses for programming. In
addition, writes to the EEPROM array cause the address and data buses to be latched. This bit is
readable and writable, but reads from the EEPROM array are inhibited if the LATCH bit is set and
a write to the EEPROM space has taken place. When this bit is clear, address and data buses are
congured for normal operation. Reset clears this bit.
EERC — EEPROM RC oscillator control
1 (set)
–
Use internal RC oscillator for EEPROM.
0 (clear) –
Use CPU clock for EEPROM.
When this bit is set, the EEPROM memory array uses the internal RC oscillator instead of the CPU
clock. After setting the EERC bit, the user should wait a time tRCON to allow the RC oscillator to
stabilize. This bit is readable and writable and should be set by the user when the internal bus
frequency falls below 1.5MHz. Reset clears this bit.
Table 3-2 Erase modes
ER1
ER0
Mode
0
Program
0
1
Byte erase
1
0
Block erase
1
Bulk erase
35
05F32Book Page 7 Tuesday, June 8, 1999 7:55 am
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC05F32CFU | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
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| MC68HC705J1AVDWR2 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO20 |
| MC68HRC705J1ACDWR2 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO20 |
| MC68HSC705J1ACDWR2 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO20 |
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参数描述 |
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