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参数资料
| 型号： | MC68HC705J2CP |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP20 |
| 封装： | PLASTIC, DIP-20 |
| 文件页数： | 30/82页 |
| 文件大小： | 2545K |
| 代理商： | MC68HC705J2CP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页当前第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页
RESETS AND INTERRUPTS
5-6
Rev. 2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
Either an edge-sensitive or an edge- and level-sensitive external interrupt trigger
is programmable in the mask option register. Figure 5-4 shows the internal logic
of this programmable option.
Figure 5-4. External Interrupt Trigger Option
The edge- and level-sensitive trigger option allows multiple external interrupt
sources to be wire-ORed to the IRQ pin. With the level-sensitive trigger option, an
external interrupt request is latched as long as any source is holding the IRQ pin
low.
Setting the interrupt mask in the condition code register disables external
interrupts.
5.2.3 Software Interrupt
The software interrupt (SWI) instruction causes a nonmaskable interrupt.
VDD
D
C
Q
R
EXTERNAL
INTERRUPT
REQUEST
EXTERNAL INTERRUPT
BEING SERVICED
(VECTOR FETCH)
RESET
INTERRUPT MASK
LEVEL SENSITIVE TRIGGER
(MOR OPTION)
IRQ
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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