参数资料
| 型号： | MC68HC705JJ7CDW |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 61/164页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 20-SOIC |
| 标准包装： | 38 |
| 系列： | HC05 |
| 核心处理器： | HC05 |
| 芯体尺寸： | 8-位 |
| 速度： | 2.1MHz |
| 连通性： | SIO |
| 外围设备： | POR，温度传感器，WDT |
| 输入/输出数： | 14 |
| 程序存储器容量： | 6KB（6K x 8） |
| 程序存储器类型： | OTP |
| RAM 容量： | 224 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 4x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
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SIOP Timing (VDD = 5.0 Vdc)
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
Freescale Semiconductor
153
15.14 SIOP Timing (VDD = 5.0 Vdc)
Figure 15-11. SIOP Timing Diagram
Characteristic(1)
1. +4.5
≤ VDD ≤ +5.5 V, VSS = 0 V, TL ≤ TA ≤ TH, unless otherwise noted
Symbol
Min
Typ
Max
Unit
Frequency of operation
Master
Slave
fSIOP(M)
fSIOP(S)
0.25 x fOP
dc
0.25 x fOP
—
0.25 x fOP
1050
kHz
Cycle time
Master
Slave
tSCK(M)
4.0 x tcyc
—
4.0 x tcyc
—
4.0 x tcyc
3.8
s
Clock (SCK) low time (fOP = 4.2 MHz)
tSCKL
952
—
ns
SDO data valid time
tV
—
200
ns
SDO hold time
tHO
0—
—
ns
SDI setup time
tS
100
—
ns
SDI hold time
tH
100
—
ns
tSCK
SCK
tSCKL
tV
tHO
SDO
MSB
BIT 1
LSB
tH
tS
SDI
MSB
LSB
VALID DATA
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PDF描述 |
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参数描述 |
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