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参数资料
| 型号： | MC68HC705KJ1CDW |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 103/108页 |
| 文件大小： | 0K |
| 描述： | IC MCU 4MHZ 1.2K OTP 16-SOIC |
| 标准包装： | 47 |
| 系列： | HC05 |
| 核心处理器： | HC05 |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 外围设备： | POR，WDT |
| 输入/输出数： | 10 |
| 程序存储器容量： | 1.2KB（1.2K x 8） |
| 程序存储器类型： | OTP |
| RAM 容量： | 64 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
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Electrical Specifications
MC68HC705KJ1 MC68HRC705KJ1 MC68HLC705KJ1 Data Sheet, Rev. 4.1
94
Freescale Semiconductor
Figure 10-8. Stop Mode Recovery Timing
Figure 10-9. Power-On Reset Timing
tILIH
OSCILLATOR STABILIZATION DELAY(5)
OSC (NOTE 1)
tRL
RESET
IRQ (NOTE 2)
IRQ (NOTE 3)
INTERNAL
CLOCK
INTERNAL
ADDRESS BUS
Notes:
1. Internal clocking from OSC1 pin
2. Edge-triggered external interrupt mask option
3. Edge- and level-triggered external interrupt mask option
4. Reset vector shown as example
RESET OR INTERRUPT
VECTOR FETCH
07FE
07FF
(NOTE 4)
5. 4064 tcyc or 128 tcyc, depending on the state of SOSCD bit in MOR
07FE
OSCILLATOR STABILIZATION DELAY(3)
VDD
OSC1 PIN
INTERNAL
CLOCK
INTERNAL
ADDRESS BUS
NOTES:
INTERNAL
DATA BUS
07FE
07FF
(NOTE 1)
1. Power-on reset threshold is typically between 1 V and 2 V.
2. Internal clock, internal address bus, and internal data bus are not available externally.
NEW
PCH
NEW
PCL
3. 4064 tcyc or 128 tcyc depending on the state of SOSCD bit in MOR
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PDF描述 |
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