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参数资料
| 型号： | MC68HC705P6AS |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| 封装： | PLASTIC, SDIP-28 |
| 文件页数： | 90/130页 |
| 文件大小： | 1541K |
| 代理商： | MC68HC705P6AS |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页当前第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页
Serial Input/Output Port (SIOP)
Advance Information
MC68HC705P6A — Rev. 2.0
62
Serial Input/Output Port (SIOP)
MOTOROLA
7.4 SIOP Registers
The SIOP is programmed and controlled by the SIOP control register
(SCR) located at address $000A, the SIOP status register (SSR) located
at address $000B, and the SIOP data register (SDR) located at address
$000C.
7.4.1 SIOP Control Register (SCR)
This register is located at address $000A and contains two bits. Figure
7-3 shows the position of each bit in the register and indicates the value
of each bit after reset.
SPE — Serial Peripheral Enable
When set, the SPE bit enables the SIOP subsystem such that
SDO/PB5 is the serial data output, SDI/PB6 is the serial data input,
and SCK/PB7 is a serial clock input in the slave mode or a serial clock
output in the master mode. Port B DDR and data registers can be
manipulated as usual (except for PB5); however, these actions could
affect the transmitted or received data.
The SPE bit is readable at any time. However, writing to the SIOP
control register while a transmission is in progress will cause the SPIF
and DCOL bits in the SIOP status register (see below) to operate
incorrectly. Therefore, the SIOP control register should be written
once to enable the SIOP and then not written to until the SIOP is to
be disabled. Clearing the SPE bit while a transmission is in progress
Address:
$000A
Bit 7
6
54321
Bit 0
Read:
0
SPE
0
MSTR
0000
Write:
Reset:
00
000000
= Unimplemented
Figure 7-3. SIOP Control Register (SCR)
相关PDF资料 |
PDF描述 |
|---|---|
| MC68HC908JL3CFA | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48 |
| MC68HRC05J5ADWR3 | 8-BIT, MROM, MICROCONTROLLER, PDSO20 |
| MC68L11K1FN2R2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQCC84 |
| MC68SEC000CFU20 | 32-BIT, 20 MHz, MICROPROCESSOR, PQFP64 |
| MC7455ARX733LG | 32-BIT, 733 MHz, RISC PROCESSOR, CBGA483 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC68HC705P6CDW | 制造商:Motorola Inc 功能描述: |
| MC68HC705P6CP | 制造商:Freescale Semiconductor 功能描述: 制造商:Motorola Inc 功能描述: |
| MC68HC705P6ECDW | 制造商:Motorola Inc 功能描述: 制造商:MOTOROLA 功能描述: |
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