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参数资料
| 型号： | MC68HC705RC17DW |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.097 MHz, MICROCONTROLLER, PDSO28 |
| 封装： | SOIC-28 |
| 文件页数： | 22/126页 |
| 文件大小： | 3079K |
| 代理商： | MC68HC705RC17DW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页当前第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
NON-DISCLOSURE
AGREEMENT
REQUIRED
Electrical Specications
General Release Specification
MC68HC705RC17 — Rev. 2.0
Electrical Specifications
13.6 DC Electrical Characteristics (5.0 Vdc)
Characteristic
Symbol
Min
Typ
Max
Unit
Output Voltage
ILoad = 10.0 A
ILoad = –10.0 A
VOL
VOH
—
VDD –0.1
—
0.1
—
V
Output High Voltage
(ILoad –2.0 mA) Port A, Port B, Port C (1–7)
(ILoad –15.0 mA) IRO
(ILoad –4.0 mA) Port C (Bit 0)
VOH
VDD –0.8
VDD –0.7
VDD –0.8
VDD –0.2
—
V
Output Low Voltage
(ILoad = 3.0 mA) Port A, Port B, Port C (1–7)
(ILoad = 25.0 mA) IRO
(ILoad = 20.0 mA) Port C (Bit 0)
VOL
—
0.2
0.4
0.8
0.4
V
Input High Voltage
Port A, Port B, Port C, IRQ, RESET, LPRST, OSC1
VIH
0.7 x VDD
—VDD
V
Input Low Voltage
Port A, Port B, Port C, IRQ, RESET, LPRST, OSC1
VIL
VSS
—
0.2 x VDD
V
Input Hysteresis (RESET)
VHYST
0.8
0.9
1
V
EPROM Programming Voltage
VPP
14.5
—
15.5
V
Supply Current (see Notes)
Run (fOP = 2.1 MHz)
Wait with PLL Enabled (fOP = 2.1 MHz)
Wait with PLL Disabled (fOP = 16.384 kHz)
Stop
25 oC
0 oC to +70 oC
IDD
—
TBD
0.4
TBD
15
30
mA
A
I/O Ports Hi-Z Leakage Current
Port A, Port B, Port C
IOZ
–10
—
10
A
Input Current
RESET, LPRST, IRQ, OSC1
PB0–PB7 with Pullups Enabled (VIN = 0.2 x VDD)
PB0–PB7 with Pullups Enabled (VIN = 0.7 x VDD)
IIn
–1
–100
–50
—
–330
–120
1
–700
–300
A
Capacitance
Ports (as Input or Output)
RESET, LPRST, IRQ
COut
CINT
—
12
8
pF
NOTES:
1.
VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = 0 °C to +70 °C, unless otherwise noted
2.
All values shown reflect average measurements.
3.
All current measurements represent the summation of current through VDD and VDDSYN supply pins.
4.
Typical values at midpoint of voltage range, 25 oC only
5.
To minimize current consumption in wait mode, disable the PLL before executing the WAIT instruction. Internal bus
speed will be that of the 32.768-kHz external frequency.
6.
Wait IDD: only core timer active
7.
Run (with PLL enabled) IDD, wait IDD (with PLL enabled): Measured using external square wave clock source
(f
OSC = 4.2 MHz); all inputs 0.2 V from rail; no dc loads; less than 50 pF on all outputs; C
L = 20 pF on OSC2. Wait
IDD (with PLL disabled): Measured using external square wave clock source (fOSC = 33 kHz).
8.
Wait, stop IDD: Port A and port C configured as inputs; port B configured as outputs; VIL = 0.2 V; VIH = VDD –0.2 V
9.
Stop IDD is measured with OSC1 = VSS.
10. Wait IDD is affected linearly by the OSC2 capacitance.
11. Pullups are designed to be capable of pulling to VIH within 10 s for a 100 pF, 4-k load.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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