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参数资料
| 型号： | MC68HC711E9MFS2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, UVPROM, 2 MHz, MICROCONTROLLER, CQCC52 |
| 封装： | WINDOWED, CERAMIC, LCC-52 |
| 文件页数： | 201/242页 |
| 文件大小： | 1672K |
| 代理商： | MC68HC711E9MFS2 |
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Conversion Process
M68HC11E Family Data Sheet, Rev. 5.1
Freescale Semiconductor
61
3.4 Conversion Process
The A/D conversion sequence begins one E-clock cycle after a write to the A/D control/status register,
ADCTL. The bits in ADCTL select the channel and the mode of conversion.
An input voltage equal to VRL converts to $00 and an input voltage equal to VRH converts to $FF (full
scale), with no overflow indication. For ratiometric conversions of this type, the source of each analog
input should use VRH as the supply voltage and be referenced to VRL.
3.5 Channel Assignments
The multiplexer allows the A/D converter to select one of 16 analog signals. Eight of these channels
correspond to port E input lines to the MCU, four of the channels are internal reference points or test
functions, and four channels are reserved. Refer to Table 3-1.
3.6 Single-Channel Operation
The two types of single-channel operation are:
1.
When SCAN = 0, the single selected channel is converted four consecutive times. The first result
is stored in A/D result register 1 (ADR1), and the fourth result is stored in ADR4. After the fourth
conversion is complete, all conversion activity is halted until a new conversion command is written
to the ADCTL register.
2.
When SCAN = 1, conversions continue to be performed on the selected channel with the fifth
conversion being stored in register ADR1 (overwriting the first conversion result), the sixth
conversion overwriting ADR2, and so on.
Table 3-1. Converter Channel Assignments
Channel
Number
Channel
Signal
Result in ADRx
if MULT = 1
1
AN0
ADR1
2
AN1
ADR2
3
AN2
ADR3
4
AN3
ADR4
5
AN4
ADR1
6
AN5
ADR2
7
AN6
ADR3
8
AN7
ADR4
9 – 12
Reserved
—
13
VRH
(1)
1. Used for factory testing
ADR1
14
VRL
(1)
ADR2
15
(VRH)/2
(1)
ADR3
16
Reserved(1)
ADR4
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