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参数资料
| 型号： | MC68HC811E2P2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PDIP48 |
| 封装： | DIP-48 |
| 文件页数： | 200/242页 |
| 文件大小： | 1672K |
| 代理商： | MC68HC811E2P2 |
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Analog-to-Digital (A/D) Converter
M68HC11E Family Data Sheet, Rev. 5.1
60
Freescale Semiconductor
3.3 A/D Converter Power-Up and Clock Select
Bit 7 of the OPTION register controls A/D converter power-up. Clearing ADPU removes power from and
disables the A/D converter system. Setting ADPU enables the A/D converter system. Stabilization of the
analog bias voltages requires a delay of as much as 100
s after turning on the A/D converter. When the
A/D converter system is operating with the MCU E clock, all switching and comparator operations are
inherently synchronized to the main MCU clocks. This allows the comparator output to be sampled at
relatively quiet times during MCU clock cycles. Since the internal RC oscillator is asynchronous to the
MCU clock, there is more error attributable to internal system clock noise. A/D converter accuracy is
reduced slightly while the internal RC oscillator is being used (CSEL = 1).
ADPU — A/D Power-Up Bit
0 = A/D powered down
1 = A/D powered up
CSEL — Clock Select Bit
0 = A/D and EEPROM use system E clock.
1 = A/D and EEPROM use internal RC clock.
IRQE — Configure IRQ for Edge-Sensitive Only Operation
Refer to Chapter 5 Resets and Interrupts.
DLY — Enable Oscillator Startup Delay Bit
0 = The oscillator startup delay coming out of stop is bypassed and the MCU resumes processing
within about four bus cycles.
1 = A delay of approximately 4000 E-clock cycles is imposed as the MCU is started up from the stop
power-saving mode. This delay allows the crystal oscillator to stabilize.
CME — Clock Monitor Enable Bit
Refer to Chapter 5 Resets and Interrupts.
Bit 2 — Not implemented
Always reads 0
CR[1:0] — COP Timer Rate Select Bits
Refer to Chapter 5 Resets and Interrupts and Chapter 9 Timing Systems.
Address: $1039
Bit 7
654321
Bit 0
Read:
ADPU
CSEL
IRQE(1)
DLY(1)
CME
CR1(1)
CR0(1)
Write:
Reset:
00010000
1. Can be written only once in first 64 cycles out of reset in normal modes or at any time in special modes
= Unimplemented
Figure 3-4. System Configuration Options Register (OPTION)
相关PDF资料 |
PDF描述 |
|---|---|
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| MC68331CFC20B1 | 32-BIT, 20 MHz, MICROCONTROLLER, PQFP132 |
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参数描述 |
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