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参数资料
| 型号： | MC68HC908GP32CB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| 封装： | PLASTIC, SDIP-42 |
| 文件页数： | 197/282页 |
| 文件大小： | 1871K |
| 代理商： | MC68HC908GP32CB |
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MC68HC08GP32
MC68HC908GP32 MC68HC08GP32 Data Sheet, Rev. 7
276
Freescale Semiconductor
A.4 Mask Option Registers
The two mask option registers at $001E and $001F (see Figure A-3 and Figure A-4) are read-only
registers. They are defined by mask options (hard-wired connections) specified at the same time as the
ROM code submission.
On the MC68HC908GP32, these two registers are called configuration registers (CONFIG2 and
CONFIG1).
The bit functions for these two registers are the same as the configuration registers in MC68HC908GP32
A.5 Reserved Registers
The two registers at $FE08 and $FF7E are reserved locations on the MC68HC08GP32.
On the MC68HC908GP32, these two locations are the FLASH control register and the FLASH block
protect register respectively.
A.6 Monitor ROM
The monitor program (monitor ROM, $FE20–$FF52) on the MC68HC08GP32 is for device testing only.
The monitor mode entry by blank reset vector bit, MODRST bit (bit 2 at $FE01), is not used in the ROM
device — the reset vector will always contain data in the MC68HC08GP32.
Address:
$001E
Bit 7
654321
Bit 0
Read:
000000
OSC-
STOPENB
SCIBDSRC
Write:
Reset:
Mask defined
= Unimplemented
Figure A-3. Mask Option Register 2 (MOR2)
Address:
$001F
Bit 7
654321
Bit 0
Read:
COPRS
LVISTOP
LVIRSTD
LVIPWRD
LVI5OR3
SSREC
STOP
COPD
Write:
Reset:
Mask defined
= Unimplemented
Figure A-4. Mask Option Register 1 (MOR1)
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