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参数资料
| 型号： | MC68HC908GR8CFA |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, MS-026BBA, LQFP-32 |
| 文件页数： | 22/286页 |
| 文件大小： | 3708K |
| 代理商： | MC68HC908GR8CFA |
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External Interrupt (IRQ)
MC68HC908GR8 MC68HC908GR4 Data Sheet, Rev. 7
118
Freescale Semiconductor
Figure 12-1. IRQ Module Block Diagram
When an interrupt pin is both falling-edge and low-level-triggered, the interrupt remains set until both of
the following occur:
Vector fetch or software clear
Return of the interrupt pin to high level
The vector fetch or software clear may occur before or after the interrupt pin returns to high level. As long
as the pin is low, the interrupt request remains pending. A reset will clear the latch and the MODE control
bit, thereby clearing the interrupt even if the pin stays low.
When set, the IMASK bit in the INTSCR mask all external interrupt requests. A latched interrupt request
is not presented to the interrupt priority logic unless the IMASK bit is clear.
NOTE
The interrupt mask (I) in the condition code register (CCR) masks all
interrupt requests, including external interrupt requests.
Addr.
Register Name
Bit 7
654321
Bit 0
$001D
IRQ Status and Control
Register (INTSCR)
Read:
0000
IRQF
0
IMASK
MODE
Write:
ACK
Reset:
00000000
= Unimplemented
Figure 12-2. IRQ I/O Register Summary
IRQ
ACK
IMASK
DQ
CK
CLR
IRQ
HIGH
INTERRUPT
TO MODE
SELECT
LOGIC
IRQ
FF
REQUEST
VDD
MODE
VOLTAGE
DETECT
SYNCHRO-
NIZER
IRQF
TO CPU FOR
BIL/BIH
INSTRUCTIONS
VECTOR
FETCH
DECODER
IN
TERNAL
ADDRE
SS
B
U
S
RESET
VDD
INTERNAL
PULLUP
DEVICE
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PDF描述 |
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