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参数资料
型号： MC68HC908GZ60CFU
厂商： FREESCALE SEMICONDUCTOR INC
元件分类： 微控制器/微处理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64
封装： QFP-64
文件页数： 226/380页
文件大小： 5022K
代理商： MC68HC908GZ60CFU
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Timer Interface Module (TIM1)
Input/Output Registers
MC68HC908GZ60 MC68HC908GZ48 MC68HC908GZ32
Data Sheet
MOTOROLA
Timer Interface Module (TIM1)
301
TOF — TIM1 Overflow Flag Bit
This read/write flag is set when the TIM1 counter reaches the modulo value
programmed in the TIM1 counter modulo registers. Clear TOF by reading the
TIM1 status and control register when TOF is set and then writing a 0 to TOF. If
another TIM1 overflow occurs before the clearing sequence is complete, then
writing 0 to TOF has no effect. Therefore, a TOF interrupt request cannot be lost
due to inadvertent clearing of TOF. Reset clears the TOF bit. Writing a 1 to TOF
has no effect.
1 = TIM1 counter has reached modulo value
0 = TIM1 counter has not reached modulo value
TOIE — TIM1 Overflow Interrupt Enable Bit
This read/write bit enables TIM1 overflow interrupts when the TOF bit becomes
set. Reset clears the TOIE bit.
1 = TIM1 overflow interrupts enabled
0 = TIM1 overflow interrupts disabled
TSTOP — TIM1 Stop Bit
This read/write bit stops the TIM1 counter. Counting resumes when TSTOP is
cleared. Reset sets the TSTOP bit, stopping the TIM1 counter until software
clears the TSTOP bit.
1 = TIM1 counter stopped
0 = TIM1 counter active
NOTE:
Do not set the TSTOP bit before entering wait mode if the TIM1 is required to exit
wait mode. Also, when the TSTOP bit is set and the timer is configured for input
capture operation, input captures are inhibited until the TSTOP bit is cleared.
TRST — TIM1 Reset Bit
Setting this write-only bit resets the TIM1 counter and the TIM1 prescaler.
Setting TRST has no effect on any other registers. Counting resumes from
$0000. TRST is cleared automatically after the TIM1 counter is reset and always
reads as 0. Reset clears the TRST bit.
1 = Prescaler and TIM1 counter cleared
0 = No effect
NOTE:
Setting the TSTOP and TRST bits simultaneously stops the TIM1 counter at a
value of $0000.
Address: $0020
Bit 7
654321
Bit 0
Read:
TOF
TOIE
TSTOP
00
PS2
PS1
PS0
Write:
0
TRST
Reset:
00100000
= Unimplemented
Figure 18-5. TIM1 Status and Control Register (T1SC)
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PDF描述
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参数描述
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