参数资料
型号: MC68HSR705J1ADWR2
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDSO20
封装: SOIC-20
文件页数: 129/162页
文件大小: 1517K
代理商: MC68HSR705J1ADWR2
Resets and Interrupts
Resets
MC68HC705J1A — Rev. 3.0
Technical Data
MOTOROLA
Resets and Interrupts
69
4.3.1 Power-On Reset
A positive transition on the VDD pin generates a power-on reset.
NOTE:
The power-on reset is strictly for power-up conditions and cannot be
used to detect drops in power supply voltage.
A 4064-tcyc (internal clock cycle) delay after the oscillator becomes
active allows the clock generator to stabilize. If any reset source is active
at the end of this delay, the MCU remains in the reset condition until all
reset sources are inactive.
Figure 4-2. Power-On Reset Timing
OSCILLATOR STABILIZATION DELAY
VDD
OSC1 PIN
INTERNAL
CLOCK
INTERNAL
ADDRESS BUS
Notes:
INTERNAL
DATA BUS
1. Power-on reset threshold is typically between 1 V and 2 V.
2. Internal clock, internal address bus, and internal data bus are not available externally.
$07FE
$07FF
NEW PCH
NEW PCL
(NOTE 1)
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PDF描述
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