参数资料
型号: MC705X32MFUE4R
厂商: Freescale Semiconductor
文件页数: 224/232页
文件大小: 0K
描述: IC MCU 8BIT 32K FLASH 64-QFP
标准包装: 1
系列: HC05
核心处理器: HC05
芯体尺寸: 8-位
速度: 4MHz
连通性: CAN,SCI
外围设备: POR,WDT
输入/输出数: 24
程序存储器容量: 32KB(32K x 8)
程序存储器类型: OTP
EEPROM 大小: 256 x 8
RAM 容量: 528 x 8
电压 - 电源 (Vcc/Vdd): 4.5 V ~ 5.5 V
数据转换器: A/D 8x8b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 64-QFP
包装: 标准包装
其它名称: MC705X32MFUE4RDKR
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MC68HC05X16
6-3
PROGRAMMABLE TIMER
6
6.1.1
Counter register and alternate counter register
The double-byte, free-running counter can be read from either of two locations, $18-$19 (counter
register) or $1A-$1B (alternate counter register). A read from only the less signicant byte (LSB)
of the free-running counter ($19 or $1B) receives the count value at the time of the read. If a read
of the free-running counter or alternate counter register rst addresses the more signicant byte
(MSB) ($18 or $1A), the LSB is transferred to a buffer. This buffer value remains xed after the rst
MSB read, even if the user reads the MSB several times. This buffer is accessed when reading the
free-running counter or alternate counter register LSB and thus completes a read sequence of the
total counter value. In reading either the free-running counter or alternate counter register, if the
MSB is read, the LSB must also be read to complete the sequence. If the timer overow ag (TOF)
is set when the counter register LSB is read then a read of the timer status register (TSR) will clear
the ag.
The alternate counter register differs from the counter register only in that a read of the LSB does
not clear TOF. Therefore, where it is critical to avoid the possibility of missing timer overow
interrupts due to clearing of TOF, the alternate counter register should be used.
The free-running counter is set to $FFFC during power-on and external reset and is always a
read-only register. During a power-on reset, the counter begins running after the oscillator start-up
delay. Because the free-running counter is 16 bits preceded by a xed divide-by-4 prescaler, the
value in the free-running counter repeats every 262,144 internal bus clock cycles. TOF is set when
the counter overows (from $FFFF to $0000); this will cause an interrupt if TOIE is set.
In some particular timing control applications it may be desirable to reset the 16-bit free running
counter under software control. When the low byte of the counter ($19 or $1B) is written to, the
counter is congured to its reset value ($FFFC).
The divide-by-4 prescaler is also reset and the counter resumes normal counting operation. All of
the ags and enable bits remain unaltered by this operation. If access has previously been made
to the high byte of the free-running counter ($18 or $1A), then the reset counter operation
terminates the access sequence.
Warning: This operation may affect the function of the watchdog system (see Section 10.1.4).
The PLM results will also be affected while resetting the counter.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Timer counter high
$0018
1111 1111
Timer counter low
$0019
1111 1100
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Alternate counter high
$001A
1111 1111
Alternate counter low
$001B
1111 1100
89
F
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Freescale Semiconductor, Inc.
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PDF描述
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