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参数资料
| 型号： | MC8641VU1333JE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 107/130页 |
| 文件大小： | 0K |
| 描述： | IC MPU SGL CORE E600 1023FCCBGA |
| 标准包装： | 1 |
| 系列： | MPC86xx |
| 处理器类型： | 32-位 MPC86xx PowerPC |
| 速度： | 1.333GHz |
| 电压： | 1.05V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 994-BCBGA，FCCBGA |
| 供应商设备封装： | 994-FCCBGA（33x33） |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页当前第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页
MPC8641 and MPC8641D Integrated Host Processor Hardware Specifications, Rev. 2
78
Freescale Semiconductor
Serial RapidIO
15.2
AC Requirements for Serial RapidIO SD
n_REF_CLK and
SD
n_REF_CLK
Table 51 lists AC requirements.
15.3
Signal Definitions
LP-Serial links use differential signaling. This section defines terms used in the description and
specification of differential signals. Figure 53 shows how the signals are defined. The figures show
waveforms for either a transmitter output (TD and TD) or a receiver input (RD and RD). Each signal
swings between A Volts and B Volts where A > B. Using these waveforms, the definitions are as follows:
1. The transmitter output signals and the receiver input signals TD, TD, RD and RD each have a
peak-to-peak swing of A – B Volts
2. The differential output signal of the transmitter, VOD, is defined as VTD–VTD
3. The differential input signal of the receiver, VID, is defined as VRD–VRD
4. The differential output signal of the transmitter and the differential input signal of the receiver
each range from A – B to –(A – B) Volts
5. The peak value of the differential transmitter output signal and the differential receiver input
signal is A – B Volts
6. The peak-to-peak value of the differential transmitter output signal and the differential receiver
input signal is 2 * (A – B) Volts
Figure 53. Differential Peak-Peak Voltage of Transmitter or Receiver
Table 51. SD
n_REF_CLK and SDn_REF_CLK AC Requirements
Symbol
Parameter Description
Min
Typical
Max
Units
Comments
tREF
REFCLK cycle time
—
10(8)
—
ns
8 ns applies only to serial RapidIO
with 125-MHz reference clock
tREFCJ
REFCLK cycle-to-cycle jitter. Difference in the
period of any two adjacent REFCLK cycles
—
80
ps
—
tREFPJ
Phase jitter. Deviation in edge location with
respect to mean edge location
–40
—
40
ps
—
Differential Peak-Peak = 2 * (A-B)
A Volts
TD or RD
B Volts
相关PDF资料 |
PDF描述 |
|---|---|
| IDT70V35S20PF | IC SRAM 144KBIT 20NS 100TQFP |
| MC8641HX1333JE | IC DUAL CORE PROCESSOR 994-CBGA |
| IDT70V25S35PF | IC SRAM 128KBIT 35NS 100TQFP |
| P4080NSE1MMB | IC MPU 1200MHZ |
| IDT70914S15JI8 | IC SRAM 36KBIT 15NS 68PLCC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC8641VU1333K | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641VU1333N | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641VU1500G | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641VU1500H | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
| MC8641VU1500J | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Integrated Host Processor Hardware Specifications |
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