参数资料
型号: MC908JL16CPE
厂商: Freescale Semiconductor
文件页数: 16/230页
文件大小: 0K
描述: IC MCU 16K FLASH 8MHZ 28-DIP
标准包装: 13
系列: HC08
核心处理器: HC08
芯体尺寸: 8-位
速度: 8MHz
连通性: I²C,SCI
外围设备: LED,LVD,POR,PWM
输入/输出数: 23
程序存储器容量: 16KB(16K x 8)
程序存储器类型: 闪存
RAM 容量: 512 x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 5.5 V
数据转换器: A/D 12x10b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 28-DIP(0.600",15.24mm)
包装: 管件
产品目录页面: 724 (CN2011-ZH PDF)
配用: DEMO908JL16E-ND - BOARD DEMO FOR MC908JL16
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Multi-Master IIC Interface (MMIIC)
MC68HC908JL16 Data Sheet, Rev. 1.1
112
Freescale Semiconductor
8.4.3 Slave Address Transmission
The first byte of data transfer immediately after the START signal is the slave address transmitted by the
master. This is a seven-bit calling address followed by a R/W bit. The R/W bit tells the slave the desired
direction of data transfer.
1 = Read transfer, the slave transmits data to the master.
0 = Write transfer, the master transmits data to the slave.
Only the slave with a calling address that matches the one transmitted by the master will respond by
sending back an acknowledge bit. This is done by pulling the SDA low at the 9th clock (see Figure 8-2).
No two slaves in the system may have the same address. If the IIC is master and it transmits an address
that is equal to its own slave address an interrupt flag is set. The IIC cannot be master and slave at the
same time. However, if arbitration is lost during an address cycle the IIC will revert to slave mode and
operate correctly even if it is being addressed by another master.
8.4.4 Data Transfer
Once successful slave addressing is achieved, the data transfer can proceed byte-by-byte in a direction
specified by the R/W bit sent by the calling master.
All transfers that come after an address cycle are referred to as data transfers, even if they carry
sub-address information for the slave device
Each data byte is 8 bits long. Data may be changed only while SCL is low and must be held stable while
SCL is high as shown in Figure 8-2. There is one clock pulse on SCL for each data bit, the MSB being
transferred first. Each data byte is followed by a 9th (acknowledge) bit, which is signalled from the
receiving device. An acknowledge is signalled by pulling the SDA low at the ninth clock. In summary, one
complete data transfer needs nine clock pulses.
If the slave receiver does not acknowledge the master in the 9th bit time, the SDA line must be left high
by the slave. The master interprets the failed acknowledge as an unsuccessful data transfer.
If the master receiver does not acknowledge the slave transmitter after a data byte transmission, the slave
interprets this as an end of data transfer and releases the SDA line.
In either case, the data transfer is aborted and the master does one of two things:
Relinquishes the bus by generating a STOP signal.
Commences a new calling by generating a repeated START signal.
8.4.5 STOP Signal
The master can terminate the communication by generating a STOP signal to free the bus. However, the
master may generate a START signal followed by a calling command without generating a STOP signal
first. This is called repeated START. A STOP signal is defined as a low-to-high transition of SDA while
SCL at logical “1” (see Figure 8-2).
The master can generate a STOP even if the slave has generated an acknowledge at which point the
slave must release the bus.
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MC908JL3ECDWE 功能描述:8位微控制器 -MCU PB-FREE FINISHED GOODS RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT