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参数资料
| 型号： | MC908QB4MP |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP16 |
| 封装： | PLASTIC, DIP-16 |
| 文件页数： | 22/236页 |
| 文件大小： | 1690K |
| 代理商： | MC908QB4MP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页当前第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页
Enhanced Serial Communications Interface (ESCI) Module
MC68HC908QB8 Data Sheet, Rev. 1
118
Freescale Semiconductor
Slow Data Tolerance
Figure 13-7 shows how much a slow received character can be misaligned without causing a noise error
or a framing error. The slow stop bit begins at RT8 instead of RT1 but arrives in time for the stop bit data
samples at RT8, RT9, and RT10.
Figure 13-7. Slow Data
For an 8-bit character, data sampling of the stop bit takes the receiver 9 bit times
× 16 RT cycles
+10RTcycles=154RTcycles.
With the misaligned character shown in Figure 13-7, the receiver counts 154 RT cycles at the point when
the count of the transmitting device is 9 bit times
× 16 RT cycles + 3 RT cycles = 147 RT cycles.
The maximum percent difference between the receiver count and the transmitter count of a slow 8-bit
character with no errors is:
For a 9-bit character, data sampling of the stop bit takes the receiver 10 bit times
× 16 RT cycles
+10RTcycles=170RTcycles.
With the misaligned character shown in Figure 13-7, the receiver counts 170 RT cycles at the point when
the count of the transmitting device is 10 bit times
× 16 RT cycles + 3 RT cycles = 163 RT cycles.
The maximum percent difference between the receiver count and the transmitter count of a slow 9-bit
character with no errors is:
Fast Data Tolerance
Figure 13-8 shows how much a fast received character can be misaligned without causing a noise error
or a framing error. The fast stop bit ends at RT10 instead of RT16 but is still there for the stop bit data
samples at RT8, RT9, and RT10.
Figure 13-8. Fast Data
MSB
STOP
RT
1
RT
2
RT
3
RT
4
RT
5
RT
6
RT
7
RT
8
RT
9
RT1
0
RT1
1
RT1
2
RT1
3
RT1
4
RT1
5
RT1
6
DATA SAMPLES
RECEIVER
RT CLOCK
154
147
–
154
--------------------------
100
×
4.54%
=
170
163
–
170
--------------------------
100
×
4.12%
=
IDLE OR NEXT CHARACTER
STOP
RT
1
RT
2
RT
3
RT
4
RT
5
RT
6
RT
7
RT
8
RT
9
RT1
0
RT1
1
RT1
2
RT1
3
RT1
4
RT1
5
RT1
6
DATA
SAMPLES
RECEIVER
RT CLOCK
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PDF描述 |
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