参数资料
型号: MC908QY4AMPE
厂商: Freescale Semiconductor
文件页数: 106/202页
文件大小: 0K
描述: IC MCU 8BIT 4K FLASH 16-DIP
标准包装: 25
系列: HC08
核心处理器: HC08
芯体尺寸: 8-位
速度: 8MHz
外围设备: LVD,POR,PWM
输入/输出数: 13
程序存储器容量: 4KB(4K x 8)
程序存储器类型: 闪存
RAM 容量: 128 x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 5.5 V
数据转换器: A/D 6x10b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 16-DIP(0.300",7.62mm)
包装: 管件
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MC68HC908QYA/QTA Family Data Sheet, Rev. 3
192
Freescale Semiconductor
The ADC that is on the QYxA can operate while the MCU is in stop mode allowing lower power
operation. This also adds a lower noise environment for precise ADC results.
Enabling an ADC channel no longer overrides the digital I/O function of the associated pin. To
prevent the digital I/O from interfering with the ADC read of the pin, the data direction bit associated
with the port pin must be set as input.
Finally, the new ADC can be configured to select two different reference clock sources:
The internal bus x 4
An internal asynchronous source
The internal asynchronous clock source allows the ADC to be clocked for operation in stop mode.
A.2.1.1 Registers Affected
The ADCHx bits can be used to select additional ADC channels or bandgap measurement.
10-bit ADC uses the new ADRH register for the upper 2 bits.
A long sample time option has been added to conserve power at the expense of longer conversion times.
This option is selected using the new ADLSMP bit in the ADCLK register. (The bit location was previously
reserved.)
The ADC will now run in stop mode if the ACLKEN bit is set to enable the asynchronous clock inside the
ADC module. Utilizing stop mode for an ADC conversion gives the quietest operating mode to get
extremely accurate ADC readings. (This bit location now used by ACLKEN was reserved — it always read
as a 0 and writes to that location had no affect.)
Bit 7
654321
Bit 0
Read:
COCO
AIEN
ADCO
ADCH4
ADCH3
ADCH2
ADCH1
ADCH0
Write:
Reset:
00011111
= Unimplemented
Figure A-1. ADC10 Status and Control Register (ADSCR)
Bit 7
654321
Bit 0
Read:
000000
AD9
AD8
Write:
Reset:
00000000
= Unimplemented
Figure A-2. ADC10 Data Register High (ADRH), 10-Bit Mode
Bit 7
654321
Bit 0
Read:
ADLPC
ADIV1
ADIV0
ADICLK
MODE1
MODE0
ADLSMP
ACLKEN
Write:
Reset:
00000000
Figure A-3. ADC10 Clock Register (ADCLK)
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