参数资料
型号: MC912D60PCPV
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP112
封装: TQFP-112
文件页数: 302/439页
文件大小: 2323K
代理商: MC912D60PCPV
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Electrical Specifications
Advance Information
68HC(9)12D60 — Rev 4.0
370
Electrical Specifications
MOTOROLA
Table 20-6. Analog Converter Characteristics (Operating)
VDD = 5.0 Vdc ±10%, VSS = 0 Vdc, TA = TL to TH, ATD Clock = 2 MHz, unless otherwise noted
Characteristic
Symbol
Min
Typical
Max
Unit
8-bit resolution(1)
1 count
20
mV
8-bit differential non-linearity(2)
DNL
0.5
+0.5
count
8-bit integral non-linearity(2)
INL
1
+1
count
8-bit absolute error,(3)2, 4, 8, and 16 ATD sample clocks
AE
1
+1
count
10-bit resolution(1)
1 count
5
mV
10-bit differential non-linearity(2)
DNL
–2
2
count
10-bit integral non-linearity(2)
INL
–2
2
count
10-bit absolute error(3) 2, 4, 8, and 16 ATD sample clocks
AE
–2.5
2.5
count
Maximum source impedance
RS
20
See
note(4)
K
1. VRH VRL ≥ 5.12V; VDDA VSSA = 5.12V
2. At VREF = 5.12V, one 8-bit count = 20 mV, and one 10-bit count = 5mV.
INL and DNL are characterized using the process window parameters affecting the ATD accuracy, but they are not tested.
3. These values include quantization error which is inherently 1/2 count for any A/D converter. Accuracy tested when when
VRL=VSS, VRH=VDD and external source impedence is close to zero.
4. Maximum source impedance is application-dependent. Error resulting from pin leakage depends on junction leakage into
the pin and on leakage due to charge-sharing with internal capacitance.
Error from junction leakage is a function of external source impedance and input leakage current. Expected error in result
value due to junction leakage is expressed in voltage (VERRJ):
VERRJ = RS × IOFF
where IOFF is a function of operating temperature. Charge-sharing effects with internal capacitors are a function of ATD
clock speed, the number of channels being scanned, and source impedance. For 8-bit conversions, charge pump leakage
is computed as follows:
VERRJ = .25pF × VDDA × RS × ATDCLK/(8 × number of channels)
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