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参数资料
| 型号： | MC9328MX21DVKR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 12/100页 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MX21 266MHZ 289-MAPBGA |
| 标准包装： | 1,000 |
| 系列： | i.MX21 |
| 核心处理器： | ARM9 |
| 芯体尺寸： | 32-位 |
| 速度： | 266MHz |
| 连通性： | 1 线，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外围设备： | DMA，I²S，LCD，POR，PWM，WDT |
| 输入/输出数： | 192 |
| 程序存储器类型： | ROMless |
| 电压 - 电源 (Vcc/Vdd)： | 1.45 V ~ 3.3 V |
| 振荡器型： | 外部 |
| 工作温度： | -30°C ~ 70°C |
| 封装/外壳： | 289-LFBGA |
| 包装： | * |
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Specifications
MC9328MX21 Technical Data, Rev. 3.4
Freescale Semiconductor
19
Figure 3. Timing Relationship with RESET_IN
3.7
External DMA Request and Grant
The External DMA request is an active low signal to be used by devices external to i.MX21 processor to
request the DMAC for data transfer.
After assertion of External DMA request the DMA burst will start when the channel on which the External
request is the source (as per the RSSR settings) becomes the current highest priority channel. The external
device using the External DMA request should keep its request asserted until it is serviced by the DMAC.
One External DMA request will initiate one DMA burst.
Table 12. Reset Module Timing Parameters
Ref
No.
Parameter
1.8 V
± 0.10 V 3.0 V ± 0.30 V
Unit
Min
Max
Min
Max
1
Width of input POWER_ON_RESET
800
–
800
–
ms
2
Width of internal POWER_ON_RESET
(CLK32 at 32 kHz)
300
ms
3
7k to 32k-cycle stretcher for SDRAM reset
7
Cycles of CLK32
4
14k to 32k-cycle stretcher for internal system reset HRESERT
and output reset at pin RESET_OUT
14
Cycles of CLK32
5
Width of external hard-reset RESET_IN
4
–
4
–
Cycles of CLK32
6
4k to 32k-cycle qualifier
4
Cycles of CLK32
14 cycles @ CLK32
RESET_IN
CLK32
HCLK
5
4
HRESET
RESET_OUT
6
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PDF描述 |
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